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用Modelsim独立仿真带Vivado IP核的仿真工程

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网络交换FPGA
发布2019-10-29 17:53:44
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发布2019-10-29 17:53:44
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昨天介绍了用ModlSim独立仿真带ISE IP核的仿真工程,今天介绍用ModelSim独立仿真带Vivado IP核的仿真工程。整体步骤基本一样,只是do文件分成了两个文件。使用工具Vivado2017.2 && Modelsim 10.5。

操作步骤

1、找到Vivado调用Modelsim仿真时自动产生的仿真文件,如下图红线所示。

2、在behave文件夹同级路径下新建立一个文件夹,本实例中为test。

3、将所需的仿真文件复制到新文件夹中。

4、将两个.do文件的内容合并成一个文件。

我采取的办法是新建一个.do文件,即tb_top_test.do,然后用sublime打开tb_top_compile.do,将除quit –force语句的其他所有内容复制进tb_top_test.do,然后用sublime打开tb_top_simulate.do,将除do {tb_top_wave.do}和接下来的语句的其他所有内容复制进tb_top_test.do,然后保存tb_top_test.do。

5、打开modelsim,新建工程,在Project_location选步骤3新建的文件夹,Copy_SettingsFrom选择该文件夹下的modelsim.ini文件,然后点击OK.

6、点击close

7、运行步骤4所生成的.do文件

8、运行后会出现下图所示的界面,将信号添加进波形图。

9、在波形界面进行仿真,第一次运行出现下图所示界面,点击否(这个界面可能多次弹出,点否就行了)。

10、再进行仿真,即可得到波形图

参考文献

https://cloud.tencent.com/developer/article/1137595

https://blog.csdn.net/u013098336/article/details/80809586

https://blog.csdn.net/USB_ABC/article/details/69897590

https://blog.csdn.net/ningan1987/article/details/4657410

http://www.voidcn.com/article/p-efujwurl-ds.html

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原始发表:2018-09-09,如有侵权请联系 cloudcommunity@tencent.com 删除

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