专栏首页Lauren的FPGAVivado 2019.1新特性(3):增量综合

Vivado 2019.1新特性(3):增量综合

自增量布局布线之后,Xilinx在Vivado 2019.1版本中正式发布了增量综合。可以借助Tcl脚本完成,也可以在图形界面下完成,其流程和增量布局布线很类似。

增量综合要求给工具提供一个参考的综合后的DCP,用于检测更新后的设计中哪些部分需要重新综合。这种流程的最大优势在于对于小的改动,可以有效缩短编译时间,同时尽可能地减小QoR的波动。增量综合具体流程如下图所示。

在Project模式下,使用增量综合时,对于原始设计,打开综合选项设置,要确保Write Incremental Synthesis被勾选,其目的就是生成一个带有增量综合信息的DCP,等效于上图中的write_checkpoint选项-incremental_synth。常规综合是不需要这个选项的。

对于更新后的设计,如果需要使用增量综合,点击上图中蓝色椭圆标记,会弹出如下图所是对话框。该对话框的目的是用于选择参考DCP。有三个选项:可以由工具自动选择;可以用户直接指定;也可以不使用增量编译。

在Non-project模式下,对于原始设计采用如下Tcl脚本执行综合、实现。这里可以看到,代码第4行,使用了选项-incremental_synth。

对于更新后的设计,采用如下Tcl脚本执行综合、实现。这里同时使用了增量综合和增量布局布线。其中,代码第12行,用于读入增量综合时参考DCP;代码第17行,用于读入增量布局布线时参考DCP。

此外,以下几种情形会导致即使选择增量综合,工具也会对整个设计重新综合。

-设计顶层层次发生改变

-综合选项设置发生改

本文分享自微信公众号 - Lauren的FPGA(Lauren_FPGA),作者:LaurenGao

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原始发表时间:2019-06-25

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