硬件工程师面试题【1】
（DSP，嵌入式系统，电子线路，通讯，微电子，半导体）
1、下面是一些基本的数字电路知识问题，请简要回答之。
(1) 什么是 Setup和 Hold 时间？
答：Setup/Hold Time 用于测试芯片对输入信号和时钟信号之间的时间要求。建立时间(Setup Time)是指触发器的时钟信号上升沿到来以前，数据能够保持稳 定不变的时间。输入数据信号应提前时钟上升沿(如上升沿有效)T 时间到达芯片，这个T就是建立时间通常所说的 SetupTime。如不满足 Setup Time，这个数据就不能被这一时钟打入触发器，只有在下一个时钟上升沿到来时，数据才能被打入 触发器。保持时间(Hold Time)是指触发器的时钟信号上升沿到来以后，数据保持稳定不变的时间。如果 Hold Time 不够，数据同样不能被打入触发器。
(2) 什么是竞争与冒险现象？怎样判断？如何消除？
答：在组合逻辑电路中，由于门电路的输入信号经过的通路不尽相同，所产生的延时也就会不同，从而导致到达该门的时间不一致，我们把这种现象叫做竞争。由于竞争而在电路输出端可能产生尖峰脉冲或毛刺的现象叫冒险。如果布尔式中有相反的信号则可能产生竞争和冒险现象。解决方法：一是添加布尔式的消 去项，二是在芯片外部加电容。
(3) 请画出用 D 触发器实现 2 倍分频的逻辑电路
答：把 D 触发器的输出端加非门接到 D 端即可，如下图所示：
(4) 什么是"线与"逻辑，要实现它，在硬件特性上有什么具体要求？
答：线与逻辑是两个或多个输出信号相连可以实现与的功能。在硬件上，要用 OC 门来实现(漏极或者集电极开路)，为了防止因灌电流过大而烧坏 OC 门,应在 OC 门输出端接一上拉电阻(线或则是下拉电阻)。
(5) 什么是同步逻辑和异步逻辑？同步电路与异步电路有何区别？
答：同步逻辑是时钟之间有固定的因果关系。异步逻辑是各时钟之间没有固定的因果关系.电路设计可分类为同步电路设计和异步电路设计。同步电路利用时钟脉冲使其子系统同步运作，而异步电路不使用时钟脉冲做同步，其子系统是使用特殊的 “开始”和“完成”信号使之同步。异步电路具有下列优点：无时钟歪斜问题、 低电源消耗、平均效能而非最差效能、模块性、可组合和可复用性。
(7) 你知道那些常用逻辑电平？TTL 与 COMS 电平可以直接互连吗？
答：常用的电平标准，低速的有 RS232、RS485、RS422、TTL、CMOS、LVTTL、LVCMOS、ECL、ECL、LVPECL 等，高速的有 LVDS、GTL、PGTL、 CML、HSTL、SSTL 等。
一般说来，CMOS 电平比 TTL 电平有着更高的噪声容限。如果不考虑速度 和性能，一般 TTL 与 CMOS 器件可以互换。但是需要注意有时候负载效应可能 引起电路工作不正常，因为有些 TTL 电路需要下一级的输入阻抗作为负载才能 正常工作。
(6) 请画出微机接口电路中，典型的输入设备与微机接口逻辑示意图(数据接口、控制接口、锁存器/缓冲器)
典型输入设备与微机接口的逻辑示意图如下：
2、你所知道的可编程逻辑器件有哪些？
答：ROM(只读存储器)、PLA(可编程逻辑阵列)、FPLA(现场可编程逻辑阵列)、PAL(可编程阵列逻辑)GAL(通用阵列逻辑)，EPLD(可擦除的可编程逻辑器件)、 FPGA(现场可编程门阵列)、CPLD(复杂可编程逻辑器件)等 ，其中 ROM、FPLA、 PAL、GAL、EPLD 是出现较早的可编程逻辑器件，而 FPGA 和 CPLD 是当今最 流行的两类可编程逻辑器件。FPGA 是基于查找表结构的，而 CPLD 是基于乘积 项结构的。
3、用 VHDL 或 VERILOG、ABLE 描述 8 位 D 触发器逻辑
4、请简述用 EDA 软件(如 PROTEL)进行设计(包括原理图和PCB图)到调试出样机的整个过程，在各环节应注意哪些问题？
答：完成一个电子电路设计方案的整个过程大致可分：(1)原理图设计 (2)PCB 设计 (3)投板 (4)元器件焊接(5)模块化调试 (6)整机调试。注意问题如下：
(1)原理图设计阶段
注意适当加入旁路电容与去耦电容；
注意适当加入测试点和 0 欧电阻以方便调试时测试用；
注意适当加入 0 欧电阻、电感和磁珠以实现抗干扰和阻抗匹配；
(2)PCB 设计阶段
自己设计的元器件封装要特别注意以防止板打出来后元器件无法焊接；
FM 部分走线要尽量短而粗，电源和地线也要尽可能粗；
旁路电容、晶振要尽量靠近芯片对应管脚；
注意美观与使用方便；
(3)投板
说明自己需要的工艺以及对制板的要求；
(4)元器件焊接
防止出现芯片焊错位置，管脚不对应；
防止出现虚焊、漏焊、搭焊等；
(5)模块化调试
先调试电源模块，然后调试控制模块，然后再调试其它模块；
上电时动作要迅速，发现不会出现短路时在彻底接通电源；
调试一个模块时适当隔离其它模块；
各模块的技术指标一定要大于客户的要求；
(6)整机调试
如提高灵敏度等问题
5、基尔霍夫定理
KCL：电路中的任意节点，任意时刻流入该节点的电流等于流出该节点的电流（KVL同理）
6、描述反馈电路的概念，列举他们的应用
反馈是将放大器输出信号(电压或电流)的一部分或全部，回收到放大器输入端与输入信号进行比较(相加或相减)，并用比较所得的有效输入信号去控制输出，负反馈可以用来稳定输出信号或者增益，也可以扩展通频带，特别适合于自动控制系统。正反馈可以形成振荡，适合振荡电路和波形发生电路。
7、负反馈种类及其优点
电压并联反馈，电流串联反馈，电压串联反馈和电流并联反馈
降低放大器的增益灵敏度，改变输入电阻和输出电阻，改善放大器的线性和非线性失真，有效地扩展，放大器的通频带，自动调节作用
8、放大电路的频率补偿的目的是什么，有哪些方法
频率补偿是为了改变频率特性，减小时钟和相位差，使输入输出频率同步
相位补偿通常是改善稳定裕度，相位补偿与频率补偿的目标有时是矛盾的
不同的电路或者说不同的元器件对不同频率的放大倍数是不相同的，如果输入信号不是单一频率，就会造成高频放大的倍数大，低频放大的倍数小，结果输出的波形就产生了失真
放大电路中频率补偿的目的：一是改善放大电路的高频特性，而是克服由于引入负反馈而可能出 现自激振荡现象，使放大器能够稳定工作。在放大电路中，由于晶体管结电容的存在常常会使放大电路频率响应的高频段不理想，为了解决这一问题，常用的方法就是在电路中引入负反馈。然后，负反馈的引入又引入了新的问题，那就是负反馈电路会出现自激振荡现象，所以为了使放大电路能够正常稳定工作，必须对放大电路进行频率补偿。
频率补偿的方法可以分为超前补偿和滞后补偿，主要是通过接入一些阻容元件来改变放大电路的开环增益在高频段的相频特性，目前使用最多的就是锁相环
9、有源滤波器和无源滤波器的区别
无源滤波器：这种电路主要有无源元件 R、L 和 C 组成；有源滤波器：
集成运放和 R、C 组成，具有不用电感、体积小、重量轻等优点。集成运放的开环电压增益和输入阻抗均很高，输出电阻小，构成有源滤波电路后还具有一定的电压放大和缓冲作用。但集成运放带宽有限，所以目前的有源 滤波电路的工作频率难以做得很高。
10、名词解释：SRAM、SSRAM、SDRAM、压控振荡器 (VCO)
SRAM：静态 RAM；DRAM：动态 RAM；SSRAM：Synchronous Static Random Access Memory 同步静态随机访问存储器，它的一种类型的SRAM。SSRAM 的所有访问都在时钟的上升/下降沿启动。地址、数据输入和其它控制信 号均与时钟信号相关。这一点与异步 SRAM 不同，异步 SRAM 的访问独立于时 钟，数据输入和输出都由地址的变化控制。SDRAM：Synchronous DRAM 同步动态随机存储器。
11、名词解释：IRQ、BIOS、USB、VHDL、SDR。
(1) IRQ：中断请求
(2)BIOS：BIOS 是英文"Basic Input Output System"的缩略语，直译过来后中 文名称就是"基本输入输出系统"。其实，它是一组固化到计算机内主板上一个 ROM 芯片上的程序，它保存着计算机最重要的基本输入输出的程序、系统设置 信息、开机后自检程序和系统自启动程序。其主要功能是为计算机提供最底层的、 最直接的硬件设置和控制。
(3) USB：USB，是英文 Universal Serial BUS（通用串行总线）的缩写，而其 中文简称为“通串线，是一个外部总线标准，用于规范电脑与外部设备的连接和 通讯。
(4) VHDL：VHDL 的英文全写是：VHSIC（Very High Speed Integrated Circuit） Hardware Description Language.翻译成中文就是超高速集成电路硬件描述语言。主要用于描述数字系统的结构、行为、功能和接口。
(5) SDR：软件无线电，一种无线电广播通信技术，它基于软件定义的无线 通信协议而非通过硬连线实现。换言之，频带、空中接口协议和功能可通过软件 下载和更新来升级，而不用完全更换硬件。SDR 针对构建多模式、多频和多功 能无线通信设备的问题提供有效而安全的解决方案。
12、单片机上电后没有运转，首先要检查什么
首先应该确认电源电压是否正常。用电压表测量接地引脚跟电源引脚之间的电压，看是否是电源电压，例如常用的 5V。接下来就是检查复位引脚电压 是否正常。分别测量按下复位按钮和放开复位按钮的电压值，看是否正确。然后 再检查晶振是否起振了，一般用示波器来看晶振引脚的波形，注意应该使用示波 器探头的“X10”档。另一个办法是测量复位状态下的 IO 口电平，按住复位键 不放，然后测量 IO 口(没接外部上拉的 P0 口除外)的电压，看是否是高电平，如 果不是高电平，则多半是因为晶振没有起振。另外还要注意的地方是，如果使用片内 ROM 的话(大部分情况下如此，现在 已经很少有用外部扩 ROM 的了)，一定要将 EA 引脚拉高，否则会出现程序乱跑 的情况。有时用仿真器可以，而烧入片子不行，往往是因为 EA 引脚没拉高的缘 故(当然，晶振没起振也是原因只一)。经过上面几点的检查，一般即可排除故障 了。如果系统不稳定的话，有时是因为电源滤波不好导致的。在单片机的电源引 脚跟地引脚之间接上一个 0.1uF 的电容会有所改善。如果电源没有滤波电容的话， 则需要再接一个更大滤波电容，例如 220uF 的。遇到系统不稳定时，就可以并上 电容试试(越靠近芯片越好)。
13、最基本的三极管曲线特性
答：三极管的曲线特性即指三极管的伏安特性曲线，包括输入特性曲线和输 出特性曲线。输入特性是指三极管输入回路中，加在基极和发射极的电压VBE 与 由它所产生的基极电流 I B 之间的关系。输出特性通常是指在一定的基极电流 I B控制下，三极管的集电极与发射极之间的电压VCE 同集电极电流 IC 的关系
图(1) 典型输入特性曲线
图(2) 典型输出特性曲线
图(3) 直、交流负载线，功耗线
14、什么是频率响应，怎么才算是稳定的频率响应，简述改变频率响应曲线的几个方法
答：这里仅对放大电路的频率响应进行说明。 在放大电路中，由于电抗元件(如电容、电感线圈等)及晶体管极间电容的存在，当输入信号的频率过低或过高时，放大电路的放大倍数的数值均会降低，而且还将产生相位超前或之后现象。也就是说，放大电路的放大倍数(或者称为增 益)和输入信号频率是一种函数关系，我们就把这种函数关系成为放大电路的频 率响应或频率特性。放大电路的频率响应可以用幅频特性曲线和相频特性曲线来描述，如果一个 放大电路的幅频特性曲线是一条平行于 x 轴的直线(或在关心的频率范围内平行 于 x 轴)，而相频特性曲线是一条通过原点的直线(或在关心的频率范围是条通过 原点的直线)，那么该频率响应就是稳定的
改变频率响应的方法主要有：(1) 改变放大电路的元器件参数；(2) 引入新的 元器件来改善现有放大电路的频率响应；(3) 在原有放大电路上串联新的放大电 路构成多级放大电路。
15、给出一个差分运放，如何进行相位补偿，并画补偿后的波特图
答：随着工作频率的升高，放大器会产生附加相移，可能使负反馈变成正反馈而引起自激。进行相位补偿可以消除高频自激。相位补偿的原理是：在具有高放大倍数的中间级，利用一小电容 C（几十～几百微微法）构成电压并联负反馈 电路。可以使用电容校正、RC 校正
分别对相频特性和幅频特性进行修改。
波特图就是在画放大电路的频率特性曲线时使用对数坐标。波特图由对数幅 频特性和对数相频特性两部分组成，它们的横轴采用对数刻度 lg f ，幅频特性的纵轴采用 lg |Au|表示，单位为 dB；相频特性的纵轴仍用φ表示。
16、基本放大电路的种类及优缺点，广泛采用差分结构的原因
基本放大电路按其接法分为共基、共射、共集放大电路。
共射放大电路既能放大电流又能放大电压，输入电阻在三种电路中居中，输出电阻较大，频带较窄
共基放大电路只能放大电压不能放大电流，输入电阻小，电压放大倍数和输出电阻与共射放大电路相当，频率特性是三种接法中最好的电路。常用于宽频带 放大电路。
共集放大电路只能放大电流不能放大电压，是三种接法中输入电阻最大、输 出电阻最小的电路，并具有电压跟随的特点。常用于电压大电路的输入级和输 出级，在功率放大电路中也常采用射极输出的形式。
广泛采用差分结构的原因是差分结构可以抑制温度漂移现象。
17、给出一差分电路，已知其输出电压 Y+和 Y-，求共模分量和差模分量
设共模分量是 Yc，差模分量是 Yd，则可知其输
Y+=Yc+Yd Y-=Yc-Yd 可得 Yc=(Y+ + Y-)/2 Yd=(Y+ - Y-)/2
18、画出一个晶体管级的运放电路,说明原理
下图(a)给出了单极性集成运放 C14573 的电路原理图，图(b)为其放大电路部分：
图(a) C14573 电路原理图
图(b) C14573 的放大电路部分
图(a)中T1，T2和T7管构成多路电流源，为放大电路提供静态偏置电流，把偏置电路简化后，就可得到图(b)所示的放大电路部分。
第一级是以 P 沟道管T3和T4为放大管、以 N 沟道管T5和T6管构成的电 流源为有源负载，采用共源形式的双端输入、单端输出差分放大电路。由于第二 级电路从T8的栅极输入，其输入电阻非常大，所以使第一级具有很强的电压放大能力。
第二级是共源放大电路，以N沟道管T8为放大管，漏极带有源负载，因此也具有很强的电压放大能力。但其输出电阻很大，因而带负载能力较差。电容C起相位补偿作用。
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