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开源FPGA

致力于开源FPGA，一个FPGA工程师的养成之路！

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数字电路基础

十进制数转化为R进制数：整数部分，除R取余法，除到商为0为止。小数部分，乘R取整法，乘到积为0为止。

2018-12-04

8590

时序逻辑电路基础

建立时间Tsu（setup）：触发器在时钟上升沿到来之前，其数据输入端的数据必须保持不变的最小时间。

2018-10-22

1K0

FPGA&ASIC基本开发流程

这整个流程称为RTL2GDSII，利用GDSII来生产芯片的过程称作流片（Tapeout），以上是一个Fabless公司的简易设计流程，最后将GDSII送至Foundry生产芯片。

2018-10-11

8710

基于FPGA的4x4矩阵键盘驱动调试

好久不见，因为博主最近两个月有点事情，加上接着考试，考完试也有点事情要处理，最近才稍微闲了一些，这才赶紧记录分享一篇博文。FPGA驱动4x4矩阵键盘。这个其实原理是十分简单，但是由于博主做的时候遇到了一些有意思的情况，所以我个人觉得值得记录分享一下。

2018-08-20

1K0

Viavdo&ISE&Quartus II调用Modelsim级联仿真

博主一直致力寻找高效的工作方式，所以一直喜欢折腾软件，从刚开始只用软件IDE自带的编辑器，到Notepad++，再到后来的Vim，从用ISE14.7自带的Isim仿真，到发现更好的Modelsim，再到使用do脚本自动化仿真，乐此不疲。之前一直使用Modelsim独立仿真，虽然好用，但是对于IP Core的仿真可真是麻烦，需要找到对应的IP Core库文件，所以博主一直在寻找把FPGA开发工具和Modelsim级联起来的方法，终于被我找到，分享出来！ Vivado2017.3与Modelsim级联

2018-05-28

1.2K0

IIC协议学习笔记

　　IIC总线（Inter-Integrated Circuit）即集成电路总线，是PHILIPS公司设计出来的一种简单、双向、二线制、同步串行总线。IIC总线是一个多向控制总线，多个器件（从机）可以同时挂载到一个主机控制的一条总线上。每个连接在总线上的设备都是通过唯一的地址和其他器件通信，主机和从机的角色可互换，主机和从机的概念。主机就是负责整个系统的任务协调与分配，从机一般是通过接收主机的指令从而完成某些特定的任务，主机和从机之间通过总线连接，进行数据通讯。我们平时使用的个人电脑也就是这个概念。　

2018-04-02

1.1K0

如何高效的编写Verilog HDL——进阶版

　　博主之前写过一篇文章来谈论如何高效的编写Verlog HDL——菜鸟版，在其中主要强调了使用Notepad++来编写Verilog HDL语言的便捷性，为什么说是菜鸟版呢，因为对于新手来说，在还没有熟悉软件和硬件描述语言的时候，使用Notepad++不需要学习成本，几分钟就能用好，利用其中一些功能，便能相对快捷高效的编写代码。很多人习惯了使用Notepad++，包括我在内。但是当我遇见了它——Vim。相对来说Vim就需要一段时间去适应学习，而且还要合理运用才能发挥出它的最大效率。　　Vim其实一款Li

2018-04-02

3.4K0

纠错：基于FPGA串口发送彩色图片数据至VGA显示

2018-01-05

1.1K0

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