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陌上风骑驴看IC

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Joules Xreplay
胖友们大家好,太久不见,大家都还好吗?发量减少了多少?脂肪堆积了多少?核酸码绿着吗?股票红着吗?大部分驴友都深陷在口罩围起的囹圄之中,辗转徘徊无可奈何却又不得不逆来顺受,接受这时代落下的粒粒灰尘,背负着转圈或是前行。遥想三年之前,我们踏海攀山远渡重洋去欣赏历史遗留的美好跟自然赠予的壮阔,跟陌生人聚在一起喝酒聊天畅想无尽的未来。如今,核酸码禁锢了一切,“病毒”扰乱了一切的秩序,每个人都成了“饿汉”只能顾着眼前,似乎今天的码还绿着就已是最大的幸运跟恩赐,连回家探亲这么理所应当的事都成了大逆不道贪得无厌,得谢深刻严肃真诚的谢!
老秃胖驴
2023-01-11
9561
低功耗 | UPF + CLP
每年都有新客户的感觉特别好,总能遇到新的人结成新的关系摩擦出新的火花,当然公司也能赚到新的钱。从大理浪完回来之后的一周大部分时间都在看UPF 跟CLP,其实这两个点之前也写过,再搬出来写一写,你们可以再看一看,大部分问题自己就可以解决了<巨大的私心>。
老秃胖驴
2022-02-23
2.8K0
GPGPU: C记 RTL 到Signoff 流程全解密
题记:7月15 号,浦东嘉里城,跟大神面对面,如果你还未注册可以dian点击链接注册:【上海线下】报名中!2021 CadenceCONNECT:异构计算设计——GPGPU完整解决方案
老秃胖驴
2021-07-20
2.1K0
Post-Mask ECO, GA Cells
Post-Mask ECO 就是不动base layer 只动金属层的ECO, Post-Mask ECO 可行的前提是设计里有足够的可供新功能实现的cell, 如Spare cell, Freed cell, GA cell. 下图为Confomal ECO 做post-mask ECO 的流程,通常简单的ECO 可以通过手工完成,但是对于复杂的ECO 必须借助于工具。Post-Mask ECO 的目的十分单纯:省钱省时间。
老秃胖驴
2021-03-22
2.1K0
软硬件融合的时代
按照单位计算的复杂度,处理器平台大致分为CPU、协处理器、GPU、FPGA、ASIC。从左往右,单位计算越来越复杂,灵活性越来越低。也即是说CPU具有最高的灵活性以及相对最低的性能;而ASIC则具有最高的性能以及相对最低的灵活性。
老秃胖驴
2021-01-18
1.3K0
combinational clock gating Vs sequential clock gating
关于clock gating 已经写过:《clock gating | 从ICG cell 在 library 中的定义说起》《clock gating | Gating 的插入与验证》《clock gating | clock gating 的timing check》《clock gating | ODC-based Clock Gating》。最近在学习Joules 20.1 update training 时又接触到了两个新概念:combinational clock gating 跟 sequential clock gating, 觍着老脸去问研发大爷这是啥,大爷说:你丫不能自己谷歌一下吗?于是在ElectronicDesign 上找到了一篇好文章,深入简出地描述了两者的区别。
老秃胖驴
2021-01-18
2.2K0
RTL 加密
生活是需要热爱的,尤其在隆冬季节。据说B 站时下流行对对子,于是集美们见缝插针地对了起来,搬一个来图个热闹。
老秃胖驴
2021-01-05
2.5K3
innovus | dbGet 一文打尽
有驴友在后台问Innovus 的dbGet, 老驴是从Common UI 开始学习Innovus 的,所以并不熟悉dbGet, Common UI 的get_db 也很好用。在support.cadence.com 上有两篇写dbGet 的文章,简单明了都不用翻译的,有需要的可以看一下—— 其实老驴今天打算发另一些东西,但是因为资料还没消化,时间又紧凑,就把这两篇文章搬运一下充个数。。。
老秃胖驴
2020-12-17
6.3K0
老驴学PR | Floorplan 之一
老驴有个文史素养极高的朋友,偶尔会写一些让人起鸡皮疙瘩的东西,有次酒后老驴问他为什么不写个小说卖钱,说不定还能成为大IP 就发达了,此兄说他没有谋篇布局的能力,无法做到草蛇灰线埋伏千里。自此之后,老驴多次揣摩过『布局』这词儿,确实是个大词。在数字后端,布局也是,一切的成败都起始于布局也决定于布局,同一个设计在两个不同水平的秃硅农手里,做出的结果可能天差地别。
老秃胖驴
2020-12-03
3.4K0
ETM 抽取,应该知道的一些细节
《点论 | 多mode ETM lib》曾经写过一点ETM, 最近在跟某兄解某问题时,突觉对ETM 的胴体竟然一无所知,比如,在抽ETM 时:
老秃胖驴
2020-11-13
2.2K0
跟老驴一起学PR | init_design
设好了《跟老驴一起学PR | 数据的输入》文中提到的一坨init_XX 变量之后,下一步就是执行init_design. 在innovus 中saveDesign 会写出一个.globals 的文件,在这个文件中有控制变量跟这一坨init_XX 变量。执行init_design 命令,会发生:
老秃胖驴
2020-11-06
3.1K0
跟老驴一起学PR | 数据的输入
前文《跟老驴一起学PR | Innovus 输入》阐述了 Innovus 所需要的输入数据有哪些,今天来学习如何将这些数据读入Innovus. 以前熟悉的工具,不论是综合、formal 还是STA 读入数据大多都是read_xxx 命令读入,思维定势之前以为Innovus 也是用一坨read_xxx 的命令读入,然而并不是。
老秃胖驴
2020-10-29
3K0
跟老驴一起学PR | Innovus 输入
基于两个事实——工作需求,码文需求 —— 从今儿开始,老驴要系统地学习一下PR,从innovus 的user guide 开始,同时会找个不大不小的设计实操,会将学习笔记发到驴号,这部分内容太过初级,适合于小朋友跟老驴这种从头开始学习的老不懂。
老秃胖驴
2020-10-29
4.7K0
Clock Domain Crossing, 跨时钟域检查
如今典型的SOC 芯片都功能复杂、接口丰富,在众多复杂功能中不可能所有功能都同时工作,为了能耗,大多数SOC 芯片都会切分成多个电压域,而丰富的接口就意味着庞杂的clock 和reset. 信号跨越不同domain 时都需要特别处理,比如跨power domain 时需要插入isolation 或level shifter 或 ELS, 对power domain 的处理,需要理清power domain 的关系,定义清楚power intent, 在设计、验证、实现端都需要做额外处理;相对于Power domain, 信号跨越Clock domains 给设计、验证、实现带来的挑战会更大, 今天捋一捋实现端对跨Clock domains 的处理,主要是CDC check.
老秃胖驴
2020-10-29
3.2K0
闲谈 | 生而为人的无可奈何
生而为人,有哪些无可奈何?之前一位驴友曰:《长安十二时辰》里面徐彬说:"求而不得是一切犯罪的根源",感觉说的太对,已经包含了所有的无可奈何。
老秃胖驴
2020-10-10
6410
专题 | Innovus 2020: 创新,永无止境
Innovus 自诞生以来,就以『多快好省』四大神功,横扫天下。一边是设计规模跟设计复杂度不停增加,一边是工艺结点不断缩小,驱使着PR 工具风驰电掣地往前奔跑,从2020 年CdnLive 大会上C 记Innovus 研发VP 罗博士的精彩演讲中可以看到Innovus 的众多耀眼创新,强烈建议反复回看,十分强烈建议自己动手用一用试一试,有的东西不试永远不知道其迷人之处。老驴根据自己的观后结合原演讲思路总结为:
老秃胖驴
2020-09-14
1.5K0
专题 | 后摩尔时代,SignOff 挑战及解决方案
2020 年突如其来的疫情,不停地改变着我们的生活,一年一度的CdnLive 也『被迫』搬上了云端,从今天开始所有2020 年CdnLive 大会视频回放开放,老驴见缝插针地回看了几个研发大拿的演讲,所有技术热点的背后都要有平台的支撑,所谓的平台也就是解决方案,从ML 到3D IC, 我们看到技术耀眼的光,也深切体会到新技术带来的挑战,总有极少数的人类昂首直面这些挑战。C 记 Voltus 研发总监曾博士在今年的CDNLive 大会上分享了半导体工艺发展对签收工具带来的新挑战,及C 记在应对这些挑战的解决方案。
老秃胖驴
2020-09-14
1.1K0
低功耗 | Glitch Power 分析
老驴发现『问题』地出现是有聚集效应的——某段时间突然间许多人都在关心Congestion 就像每个客户的每个Design 都被Congestion 阻挡住了前进步伐;而另一段时间大家又突然开始关心面积,面积是天面积是地面积是可以牺牲其他一切来换取的『核心价值』;而最近大家又一股脑的都关心起了功耗,几毫瓦几毫瓦地扣,乍看都笼罩了层匠人精神。
老秃胖驴
2020-08-10
4K0
P&R | 如何在实现全流程中考虑IR-Drop
随着工艺进步,芯片上的线宽越来越窄,单位电阻也越来越大,而同时设计的复杂度也越来越高,芯片尺寸非但没有减小还长得更大了,以至于绕线越来密集,这对电源完整性提出了新的挑战,维基百科上对电源完整性的定义是:Power integrity: or PI is the analysis to check whether the desired voltage and current are met from source to destination. 对应于数字实现就是IR 跟EM 的分析。对于老工艺,IR 跟EM 在设计末期去修干净即可,但到了新工艺点,如果把IR 跟EM 留到最后再看,是在玩火,因为极可能修不掉需要重头再来。所以亟需在实现早期就去考虑PI, 此处就需要了解一下C 记的IR-Aware 全家桶 —— Innovus + PVS + voltus + Tempus —— 从IR-Aware Placement 到 IR-Aware CCOPT 到reinforce_pg 到Tempus ECO IR drop fixing 到PVS TBF-PG 到Power Grid Optimization.
老秃胖驴
2020-08-10
2.4K0
低功耗 | 从综合到PostRoute 功耗的Gap 有多大
PPA, Performance, Power, Area 是衡量一颗芯片的基本指标,这三大指标中Power 是最诡诈的,它不像Performance 跟Area 是可相对精确计算的,而Power 在芯片回来之前都只能估算,至于估算值跟实际值相差几何,也是一个说不清道不明的东西,部分讨论可回顾《探讨 | 功耗应该在哪个corner 看?》。至于为什么,老驴大致总结了几点,请驴友补充:
老秃胖驴
2020-07-09
1.6K0
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