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陌上风骑驴看IC

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P&R | 汽车电子,Functional Safety 在place阶段的特别处理
Functional Safety 是汽车电子的独特之处,在P&R 阶段有以下几点需要特别处理:
老秃胖驴
2020-06-16
9290
综合 | 优化控制
继续码综合这一趴,相关文章回顾:《综合 | 挑战与应对》《综合 | SDC 的读入与检查》《综合 | 设计读入与检查》《综合 | LEF, QRC, DEF》《综合 | 概述及 library 检查》。综合需要的输入,除了以上罗列的library, lef, QRC, RTL, SDC, DEF 之外,如果是多电压域设计还需要读入power intent 文件,也就是CPF/UPF, 对于多电压域设计,通常需要执行两次power intent commit, 即执行两次low power cell 插入:
老秃胖驴
2020-05-13
1.7K0
SDC | set_data_check
应@Fly 天 同学的要求,码一遍set_data_check, 关于SDC 有好几个兄弟号都写了很多,可以到『IC 技术圈』中找对应文章去看。
老秃胖驴
2020-04-27
6.5K0
clock gating | ODC-based Clock Gating
在当前数字电路实现中,clock gating 是节省动态功耗最有效且成本最低的办法,所以一直以来业界都在想方设法进一步去挖掘,期望用这种低成本办法进一步节省动态功耗,如XOR clock gating. 关于clock gating 驴曾码过三篇短文《clock gating | 从ICG cell 在 library 中的定义说起》、《clock gating | Gating 的插入与验证》、《clock gating | clock gating 的timing check》。
老秃胖驴
2020-04-09
1.6K0
论功耗 | 一文搞懂 UPF2.1 编写Power Intent
Power intent 内容其实十分简明,概括来说一个完整的1801 文件可以分成三部分:
老秃胖驴
2019-09-23
13.8K0
点论 | Lock-up latch
目前,在基于寄存器的同步设计中,除了ICG cell, 不期望设计中有其他latch ,所以在RTL 质量检查或综合阶段要对Latch 报警。
老秃胖驴
2019-06-03
3.6K1
Innovus 小技巧 | ScanChain reorder
接上回《论DFT | 一文读懂 ScanDEF 相关的一切》,通常,Scan chain 在综合阶段插入,如果插scan chain 时没有考虑物理信息,或者看到的物理信息不准确,或者跟P&R 工具的correlation 不好,那在P&R 阶段可能会看到距离特别远的寄存器被连到了同一条chain 上,这会浪费很多绕线资源,如果设计本来就congestion 敏感,则会使congestion 雪上加霜。
老秃胖驴
2019-05-30
5K0
论DFT | 一文读懂 ScanDEF 相关的一切
ScanDEF 用于记录Scan chain 的信息,以在不同的工具中传递,如ATPG 工具跟P&R 工具。目前常用的ScanDEF 版本是5.5,其格式如下:
老秃胖驴
2019-05-30
5.1K0
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