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开源RISC-V Hummingbird E203 | vcs+verdi仿真
打包
腾讯云测试服务
蜂鸟 E200 主要面向极低功耗与极小面积的场景，非常适合于替代Cortex-M 系列内核应用于IoT或其他低功耗场景。
数字芯片社区
2022-12-18
1.2K
0
开源verilog仿真工具 | iverilog+GTKWave
音视频点播加速
打包
Icarus Verilog极其小巧，支持全平台Windows+Linux+MacOS，并且源代码开源。通过tb文件可以生成对应的仿真波形数据文件。
数字芯片社区
2022-09-19
1.5K
0
vcs实用技巧
打包
node.js
VCS是编译型verilog仿真器，VCS先将verilog/systemverilog文件转化为C文件，在linux下编译生成的可执行文./simv即可得到仿真结果。
数字芯片社区
2022-09-19
2.3K
0
平头哥开源项目wujian100_open | 基于VCS+Verdi的仿真
linux
打包
bash
bash 指令
腾讯云测试服务
创建项目文件夹 makdir wujian100_open 进入文件夹 cd wujian100_open
数字芯片社区
2022-04-06
1.4K
0
spyglass | 常见错误lint
gui
打包
我们将分析 lint目标运行期间产生的违规行为。我们可以使用 SpyGlass GUI 中的各种调试工具来了解违规，在 RTL 代码中调试，并查看如何在 SpyGlass 环境本身中修复这些违规。并且在更改 RTL或者.prj文件之后都必须重新运行。
数字芯片社区
2021-10-11
9.2K
0
VCS入门教程(一)
打包
linux
makefile
接触Synopsys 家的VCS工具有一段时间了，在此简单分享下个人的学习笔记。供刚接触到数字前端设计的同学提供一些参考资料。在学校我们经常使用的verilog仿真软件都是quartus和modelsim，但是看一下一些公司的招聘要求，公司里使用的基本都是VCS。所以学习一下对找工作还是有帮助的。
数字芯片社区
2020-09-04
5.1K
0
VCS入门教程(二)
打包
编程算法
makefile
面向对象编程
首先我们在编写verilog模块的testbench时，可以在里面使用一些verilog的系统函数，在运行simv文件跑仿真时，进行一些控制。例如：
数字芯片社区
2020-09-04
3.2K
0
VCS入门教程(三)
打包
1.在进行功能验证时，给设计添加激励信号，查看仿真结果，需要考虑覆盖率的问题。覆盖率分为代码覆盖率（code coverage）和功能覆盖率（function coverage）。功能覆盖率就是检查设计的功能是否完善，需要考虑很多不同的情况，是使用System verilog的重点内容。代码覆盖率是检查代码是否存在冗余，检查所有的代码是否都已经执行，状态机所有的状态是否都有到达，检查 if else 和 case 条件语句的条件是否都有使用。防止一些不必要的代码浪费芯片面积，毕竟面积就意味着钱。我们这里只讨论代码覆盖率。
数字芯片社区
2020-09-04
1.7K
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开源verilog仿真工具iverilog+GTKWave初体验
打包
音视频点播加速
本文将介绍如何使用Icarus Verilog+GTKWave来进行verilog文件的编译和仿真。
数字芯片社区
2020-07-22
2.4K
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DC综合流程
打包
编程算法
① 设计之前，准备好库、HDL代码的思想、约束生成；然后根据设计思想用 RTL 源码详细地、完整地为设计建立模型、定义设计中寄存器结构和数目、定义设计中的组合电路功能、定义设计中寄存器时钟等等的设计规格和实现。
数字芯片社区
2020-07-20
1.6K
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FPGA设计三大法则
fpga
c 语言
打包
编程算法
这里的面积指的是FPGA的芯片资源，包括逻辑资源和I/O资源等；这里的速度指的是FPGA工作的最高频率（和DSP或者ARM不同，FPGA设计的工 作频率是不固定的，而是和设计本身的延迟紧密相连）。
数字芯片社区
2020-07-20
422
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Linux下VCS初体验
打包
-debug_all：表示调用UCLI和DVE，并为进一步调试DVE建立所需要的文档；
数字芯片社区
2020-07-14
1.6K
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