问VHDL，在"downto“中使用算术和变量？
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Stack Overflow用户

提问于 2010-05-08 10:58:09

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快速的VHDL问题，我现在不能访问Xilinx，因为笔记本电脑坏了，所以不能测试这个。

我想知道是否可以在“downto”语句中使用变量和算术，例如：

proc: process (x)
begin
  y <= z(x downto 0) & z(7 downto x);
end process;

谢谢。

回答已采纳

发布于 2010-05-08 18:54:52

是的，作为参考，请查看this page。数组允许整数表达式作为范围终结点的定义。

票数 2

发布于 2010-07-09 15:31:04

我的猜测是，它将合成一个庞大而丑陋的多路复用器，而不是一个简单的移位寄存器，这看起来就像你试图创建的那样。

票数 0

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原文链接：

https://stackoverflow.com/questions/2792784

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