Get Smart About Reset: Think Local, Not Global
任务计划程序服务（Task Scheduler service）是Windows操作系统中的一个核心服务，它负责管理和执行计划任务。任务计划程序服务（Task Scheduler service）在后台运行，并由 svchost.exe 进程来托管。任务计划程序服务允许用户创建、编辑和删除计划任务。用户可以通过图形用户界面（Task Scheduler GUI）、命令行工具（如schtasks）或编程接口来管理计划任务，用于在预定的时间或特定事件发生时自动执行一系列任务。
在数字系统设计中，我们传统上都认为，应该对所有的触发器设置一个主复位，这样将大大方便后续的测试工作。所以，在所有的程序中，我往往都在端口定义中使用同一个reset信号（其实好多时候根本就没有用到）。所以，当看到文档中提到，“不建议在FPGA设计中使用全局复位，或者说应该努力避免这种设计方式”时，许多设计人员（包括我）都会觉得非常难以理解，这种设计思想跟我们通常的认识是相冲突的！ 继续读下去，不知不觉发现这个白皮书讲的还真是在理。接下来把我的个人理解讲述一下。
同步电路的速度是指同步系统时钟的速度，同步时钟愈快，电路处理数据的时间间隔越短，电路在单位时间内处理的数据量就愈大。假设Tco是触发器的输入数据被时钟打入到触发器到数据到达触发器输出端的延时时间(Tco=Tsetpup+Thold)；Tdelay是组合逻辑的延时；Tsetup是Ｄ触发器的建立时间。假设数据已被时钟打入D触发器，那么数据到达第一个触发器的Ｑ输出端需要的延时时间是Tco，经过组合逻辑的延时时间为Tdelay，然后到达第二个触发器的Ｄ端，要希望时钟能在第二个触发器再次被稳定地打入触发器，则时钟的延迟必须大于Tco＋Tdelay＋Tsetup，也就是说最小的时钟周期Tmin =Tco＋Tdelay＋Tsetup，即最快的时钟频率Fmax =1/Tmin。FPGA开发软件也是通过这种方法来计算系统最高运行速度Fmax。因为Tco和Tsetup是由具体的器件工艺决定的，故设计电路时只能改变组合逻辑的延迟时间Tdelay，所以说缩短触发器间组合逻辑的延时时间是提高同步电路速度的关键所在。由于一般同步电路都大于一级锁存，而要使电路稳定工作，时钟周期必须满足最大延时要求。故只有缩短最长延时路径，才能提高电路的工作频率。可以将较大的组合逻辑分解为较小的N块，通过适当的方法平均分配组合逻辑，然后在中间插入触发器，并和原触发器使用相同的时钟，就可以避免在两个触发器之间出现过大的延时，消除速度瓶颈，这样可以提高电路的工作频率。这就是所谓"流水线"技术的基本设计思想，即原设计速度受限部分用一个时钟周期实现，采用流水线技术插入触发器后，可用N个时钟周期实现，因此系统的工作速度可以加快，吞吐量加大。注意，流水线设计会在原数据通路上加入延时，另外硬件面积也会稍有增加。
DDR SDRAM接口可以看作是上一节中所介绍的SRAM接口的一种扩展。就像SRAM接口一样，有两条主要的总线，图9-9说明了DUA和SDRAM之间的总线及其方向。由命令、地址和控制引脚（通常称为CAC）组成的第一条总线将使用以下标准方案：在存储器时钟的一个时钟沿（或每个时钟周期一次）处发送信息。双向总线由DQ（数据总线）和DQS（数据选通脉冲）组成，DDR接口的不同之处就在于双向数据选通DQS。DQS选通脉冲可用于一组数据信号，这使得数据信号（每字节一个或每半字节一个）与选通脉冲的时序紧密匹配。如果时钟是整个数据总线共用的时钟，那么使用时钟信号进行这种紧密匹配可能不可行。双向选通信号DQS可用于读操作和写操作，并且在选通脉冲的两个边沿（下降沿和上升沿，或称双倍数据速率）上都可捕获数据。在SDRAM的读模式期间，DQ总线与数据选通引脚DQS（而不是存储器的时钟引脚）同步，即DQ和DQS从SDRAM中被输出时彼此是对齐的。而对于另一个方向，即当DUA发送数据时，DQS将相移90度。请注意，数据DQ和选通DQS的沿均来自DUA内部的存储器时钟。
有一个有趣的现象，众多数字设计特别是与FPGA设计相关的教科书都特别强调整个设计最好采用唯一的时钟域。换句话说，只有一个独立的网络可以驱动一个设计中所有触发器的时钟端口。虽然这样可以简化时序分析以及减少很多与多时钟域有关的问题，但是由于FPGA外各种系统限制，只使用一个时钟常常又不现实。FPGA时常需要在两个不同时钟频率系统之间交换数据，在系统之间通过多I/O接口接收和发送数据，处理异步信号，以及为带门控时钟的低功耗ASIC进行原型验证。本章讨论一下在FPGA设计中多时钟域和异步信号处理有关的问题和解决方案，并提供实践指导。
以前就了解了Quartz这个定时框架，但是一直没有认真的去关注他，最近忽然看到已经更新到3.0.4支持异步操作了所以就写个简单的小例子看看好用不。
1、速度与面积平衡和互换原则：一个设计如果时序余量较大，所能跑的频率远高于设计要求，能可以通过模块复用来减少整个设计消耗的芯片面积，这就是用速度优势换面积的节约；反之，如果一个设计的时序要求很高，普通方法达不到设计频率，那么可以通过数据流串并转换，并行复制多个操作模块，对整个设计采用“乒乓操作”和“串并转换”的思想进行处理，在芯片输出模块处再对数据进行“并串转换”。从而实现了用面积复制换取速度的提高。
问题 1： 为什么 group by 和 order by 会使查询变慢? 答： group by 和 order by 操作通常需要创建一个临时表来处理查询的结果，所以如果查询结果很多的 话会严
0x01 什么是触发器： 触发器对表进行插入、更新、删除的时候会自动执行的特殊存储过程。触发器一般用在check约束更加复杂的约束上面。触发器和普通的存储过程的区别是：触发器是当对某一个表进行操作。诸如：update、insert、delete这些操作的时候，系统会自动调用执行该表上对应的触发器。SQL Server 2005中触发器可以分为两类：DML触发器和DDL触发器，其中DDL触发器它们会影响多种数据定义语言语句而激发，这些语句有create、alter、drop语句。 0x02 问题描述： a)通
1.static有什么用途？（请至少说明两种） 1)在函数体，一个被声明为静态的变量在这一函数被调用过程中维持其值不变。 2) 在模块内（但在函数体外），一个被声明为静态的变量可以被模块内所用函数访问，但不能被模块外其它函数访问。它是一个本地的全局变量。 3) 在模块内，一个被声明为静态的函数只可被这一模块内的其它函数调用。那就是，这个函数被限制在声明它的模块的本地范围内使用
FPGA（Field-Program mable Gate Array），即现场可编程门阵列，它是在PAL、GAL、CPLD 等可编程器件的基础上进一步发展的产物。它是作为专用集成电路领域中的一种半定制电路而出现的，既解决了定制电路的不足，又克服了原有可编程器件门电路数有限的缺点。
在 FPGA 设计中，复位起到的是同步信号的作用，能够将所有的存储元件设置成已知状态。在数字电路设计中，设计人员一般把全局复位作为一个外部引脚来实现，在加电的时候初始化设计。全局复位引脚与任何其它输入引脚类似，对 FPGA 来说往往是异步的。设计人员可以使用这个信号在 FPGA 内部对自己的设计进行异步或者同步复位。
GitLab有CI和CD功能模块，但我对Jenkins更熟悉些，所以先使用Jenkins将自动发布搭建起来，后面再继续研究GitLab的CI和CD功能。
所谓同步电路，即电路中的所有受时钟控制的单元，如触发器（ Flip Flop）或寄存器（ register）都由一个统一的全局时钟控制。如图 1.1 所示，触发器 R1 和 R2 都都由一个统一的时钟 clk 来控制时序，在 R1 和 R2 之间有一堆组合逻辑，这就是一个最简单的同步电路。
“我遇到这样一个警告，最后会引起我的全局复位信号布不通，请问该如何处理？我是把所有的变量做成能复位的。”
Firebird特性介绍：firebird是一个全功能的，强大高效的，轻量级，免维护的数据库。它很容易让您从单用户，单数据库升级到企业级的应用。 一个firebird数据库服务器能够管理多个独立的数据库，每一个数据库同时可支持多个客户端连结。总之：它是一个开源的，强大在，可以自由使用的数据库（即使是商业上的使用） 关键特性：
SELECT 以表格的方式输出，可以同时输出多个变量；而PRINT 则是以文本的方式输出，一次只能输出一个变量的值。
从大学时代第一次接触FPGA至今已有10多年的时间，至今记得当初第一次在EDA实验平台上完成数字秒表、抢答器、密码锁等实验时那个兴奋劲。当时由于没有接触到HDL硬件描述语言，设计都是在MAX+plus II原理图环境下用74系列逻辑器件搭建起来的。
，今天写的这个其实很早我就想记录下了，以前学数电的时候好像就有接触到相关的一些概念，但是后来学FPGA以后没太注意，感觉没什么关系，直到多次遇到梗以后才想着对这些概念重新了解下，特别是上几个月在求职的时候发现一些公司在招聘要求上写了需要对FPGA的架构要熟悉，那时候我还对架构有点懵逼，差点就不想玩了，然后耐着性子重新去找资料看了下，原来这些已经有过接触，这个要求上的架构指的就是FPGA的结构
XILINX FPGA 芯片整体架构如下所示，整个芯片是以BANK进行划分的，不同的工艺、器件速度和对应的时钟具有不同的BANK数量（下面截图是以K7325tffg676为例）：左边的BANK都是HR BANK，右侧的最下面三个是HP BANK，最上面的四个BANK是transceiver。
2Host API简述 使用host api,用户需要在头文件的部分包含 curand.h，并且添加CURAND的动态链接库，即在LINKER的INPUT里面添加”curand.lib;”。这个文档是基于CUDA runtime的，所以用户的代码也应该是在runtime时调用的。而driver API是不支持CURAND的。 触发器生成随机数，CURAND同过内部的封装产生伪随机数列或者真随机数列。具体的步骤如下： 1 使用函数curandCreateGenerator创建一个新的目标类型（参考 触发器类型
Dockerfile：关于Dockerfile的使用说明，我在文章《让.NetCore程序跑在任何有docker的地方》中有说到，这里不在赘述，需要的可以先看下，本文主要介绍Jenkinsfile结合dockerfile配合使用，自动构建.NetCore应用程序。
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触发器(Trigger)决定了窗口(请参阅窗口概述)博文)什么时候使用窗口函数处理窗口内元素。每个窗口分配器都带有一个默认的触发器。如果默认触发器不能满足你的要求，可以使用 trigger(...) 指定自定义的触发器。
说明： 1 tr_name ：触发器名称 2 on table/view ：触发器所作用的表。一个触发器只能作用于一个表 3 for 和after ：同义 4 after 与instead of :sql 2000新增项目afrer 与 instead of 的区别 After 在触发事件发生以后才被激活,只可以建立在表上 Instead of 代替了相应的触发事件而被执行,既可以建立在表上也可以建立在视图上 5 insert、update、delete：激活触发器的三种操作，可以同时执行，也可选其一 6 if update (col_name)：表明所作的操作对指定列是否有影响，有影响，则激活触发器。此外，因为delete 操作只对行有影响， 所以如果使用delete操作就不能用这条语句了(虽然使用也不出错，但是不能激活触发器，没意义)。 7 触发器执行时用到的两个特殊表：deleted ,inserted deleted 和inserted 可以说是一种特殊的临时表，是在进行激活触发器时由系统自动生成的，其结构与触发器作用的表结构是一样的，只是存放 的数据有差异。 8 说明deleted 与inserted 数据的差异 deleted 与inserted 数据的差异 Inserted 存放进行insert和update 操作后的数据 Deleted 存放进行delete 和update操作前的数据 注意：update 操作相当于先进行delete 再进行insert ,所以在进行update操作时，修改前的数据拷贝一条到deleted 表中，修改后的数据在存到触发器作用的表的同时，也同时生成一条拷贝到insered表中
大家好，又见面了，我是你们的朋友全栈君。 SQL语句大全 –语 句 功 能 –数据操作 SELECT –从 数据库 表中检索数据行和列 INSERT –向数据库表添加新数据行 DELETE –从数据库表中删除数据行 UPDATE –更新数据库表中的数据 -数据定义 CREATE TABLE –创建一个数据库表 DROP TABLE –从数据库中删除表 ALTER TABLE –修改数据库表结构 CREATE VIEW –创建一个视图 DROP VIEW –从数据库中删除视图 CREATE INDEX –为数据库表创建一个索引 DROP INDEX –从数据库中删除索引 CREATE PROCEDURE –创建一个存储过程 DROP PROCEDURE –从数据库中删除存储过程 CREATE TRIGGER –创建一个触发器 DROP TRIGGER –从数据库中删除触发器 CREATE SCHEMA –向数据库添加一个新模式 DROP SCHEMA –从数据库中删除一个模式 CREATE DOMAIN –创建一个数据值域 ALTER DOMAIN –改变域定义 DROP DOMAIN –从数据库中删除一个域 –数据控制 GRANT –授予用户访问权限 DENY –拒绝用户访问 REVOKE –解除用户访问权限 –事务控制 COMMIT –结束当前事务 ROLLBACK –中止当前事务 SET TRANSACTION –定义当前事务数据访问特征 –程序化SQL DECLARE –为查询设定游标 EXPLAN –为查询描述数据访问计划 OPEN –检索查询结果打开一个游标 http://hi.baidu.com/ttcc2009 FETCH –检索一行查询结果 CLOSE –关闭游标 PREPARE –为动态执行准备SQL 语句 EXECUTE –动态地执行SQL 语句 DESCRIBE –描述准备好的查询 —局部变量 declare @id char(10) –set @id = ‘10010001’ select @id = ‘10010001’ —全局变量 —必须以@@开头 –IF ELSE declare @x int @y int @z int select @x = 1 @y = 2 @z=3 if @x > @y print ‘x > y’ –打印字符串’x > y’ else if @y > @z print ‘y > z’ else print ‘z > y’ –CASE use pangu update employee set e_wage = case when job_level = ‟1‟ then e_wage*1.08 when job_level = ‟2‟ then e_wage*1.07 when job_level = ‟3‟ then e_wage*1.06 else e_wage*1.05 end –WHILE CONTINUE BREAK declare @x int @y int @c int select @x = 1 @y=1 http://hi.baidu.com/ttcc2009 while @x < 3 begin print @x –打印变量x 的值 while @y < 3 begin select @c = 100*@x + @y print @c –打印变量c 的值 select @y = @y + 1 end select @x = @x + 1 select @y = 1 end –WAITFOR –例 等待1 小时2 分零3 秒后才执行SELECT 语句 waitfor delay ‟01:02:03‟ select * from employee –例 等到晚上11 点零8 分后才执行SELECT 语句 waitfor time ‟23:08:00‟ select * from employee ***SELECT*** select *(列名) from table_name(表名) where column_name operator value ex:(宿主) select * from stock_information where stockid = str(nid) stockname = ‘str_name’ stockname like ‘% find this %’ stockname like ‘[a-zA-Z]%’ ——— ([]指定值的范围) stockname like ‘[^F-M]%’ ——— (^排除指定范围) ——— 只能在使用like关键字的where子句中使用通配符) or stockpath = ‘stock_path’ or stocknumber < 1000 and stocki
FPGA由6部分组成，分别为可编程输入/输出单元、基本可编程逻辑单元、嵌入式块RAM、丰富的布线资源、底层嵌入功能单元和内嵌专用硬核等。 每个单元简介如下： 1.可编程输入/输出单元(I/O单元) 目前大多数FPGA的I/O单元被设计为可编程模式，即通过软件的灵活配置，可适应不同的电器标准与I/O物理特性;可以调整匹配阻抗特性，上下拉电阻;可以调整输出驱动电流的大小等。 2.基本可编程逻辑单元 FPGA的基本可编程逻辑单元是由查找表(LUT)和寄存器(Reg
📷 一、FPGA的简介 FPGA（Field- Programmable Gate Array），即现场可编程门阵列，它是在 PAL、GAL、CPLD等可编程器件的基础上进一步发展出来的产物。它是作为专用集成电路（ASIC）领域中的一种半定制电路而出现的，既解决了定制电路的不足，又克服了原有可编程器件门电路数有限的缺点。 FPGA 普遍用于实现数字电路模块，用户可对 FPGA 内部的逻辑模块和 I/O模块重新配置，以实现用户的需求。它还具有静态可重复编程和动态在系统重构的特性，使得硬件的功能可以像软件一样通
MySQL是一个关系型数据库管理系统，它将数据保存在不同表中以提供数据的灵活性。MySQL所使用的 SQL 是用于访问数据库的最常用标准化语言。MySQL基础介绍 部分的创建数据库、创建数据表、更新数据、查询数据等语句都是MySQL编程的一部分。
将xp_regread（作为系统管理员）与 PowerUpSQL 一起使用。以下命令从注册表读取自动登录密码。
我们先过一遍部署 Jenkins 服务的步骤，因为网上讲这块内容的资料很多，所以我只说一些重点步骤和需要出错的点。我的需求是实现一个局域网内可用的 Jenkins 服务，部署步骤会相对简单，首先需要一台长时间开机的服务主机，这里以 Window 为例。
据Bleeping Computer网站消息，俄罗斯黑客已经开始使用一种新的代码执行技术，该技术依赖于 Microsoft PowerPoint 演示文稿（PPT）中的鼠标移动来触发恶意 PowerShell 脚本传播 Graphite 恶意软件。恶意代码不需要恶意宏来执行和下载有效负载，从而进行更隐蔽的攻击。
在流处理应用中，数据是连续不断的，因此我们不可能等到所有数据都到了才开始处理。当然我们可以每来一个消息就处理一次，但是有时我们需要做一些聚合类的处理，例如：在过去的1分钟内有多少用户点击了我们的网页。在这种情况下，我们必须定义一个窗口，用来收集最近一分钟内的数据，并对这个窗口内的数据进行计算。
大侠好，欢迎来到FPGA技术江湖，江湖偌大，相见即是缘分。大侠可以关注FPGA技术江湖，在“闯荡江湖”、"行侠仗义"栏里获取其他感兴趣的资源，或者一起煮酒言欢。
首先,我们要有个Jenkins咯,下载链接:https://jenkins.io/download/
Project Recipient List：这是一个以逗号(或者空格)分隔的收件人邮件的邮箱地址列表。允许您为每封邮件指定单独的列表。Ps：如果你想在默认收件人的基础上添加收件人：$DEFAULT_RECIPIENTS,<新的收件人>
本文针对关系型数据库的一般语法。限于篇幅，本文侧重说明用法，不会展开讲解特性、原理。篇幅较长，但内容基本涵盖了SQL语法的大部分内容。
本文针对关系型数据库的一般语法。限于篇幅，本文侧重说明用法，不会展开讲解特性、原理。
数据库中除了需要定时完成一些任务外，有时我们也想在某些表数据变化时自动执行些操作，这就要用到触发器了
官方版：Jenkins是一个开源的、提供友好操作界面的持续集成(CI)工具，起源于Hudson（Hudson是商用的），主要用于持续、自动的构建/测试软件项目、监控外部任务的运行（这个比较抽象，暂且写上，不做解释）。Jenkins用Java语言编写，可在Tomcat等流行的servlet容器中运行，也可独立运行。通常与版本管理工具(SCM)、构建工具结合使用。常用的版本控制工具有SVN、GIT，构建工具有Maven、Ant、Gradle。
众所周知，Jenkins默认提供了一个邮件通知，能在构建失败、构建不稳定等状态后发送邮件。但是它本身有很多局限性，比如它的邮件通知无法提供详细的邮件内容、无法定义发送邮件的格式、无法定义灵活的邮件接收配置等等。在这样的情况下，我们找到了Jenkins Email Extension Plugin。该插件能允许你自定义邮件通知的方方面面，比如在发送邮件时你可以自定义发送给谁，发送具体什么内容等等。本文不会告诉你如何安装该插件，关于插件的安装请参考这里。
对于逻辑级数较大的路径，常用的时序收敛的方法之一就是采用Retiming（中文翻译为重定时）。Retiming到底是怎么回事呢？我们可以通过下图理解。图中通过搬移触发器的位置减小了关键路径的逻辑级数。无论是把触发器向前搬移还是向后搬移，搬移后整个路径的Latency和搬移前的Latency保持一致。可以看到Retiming的前提是相邻路径有可供搬移的触发器，换言之，相邻路径的时序裕量较为“富余”，从这些“富余”中拿出一部分给时序较为紧张的路径。这样，时序紧张的路径其逻辑级数降低了，而相邻的时序“富余”的路径逻辑级数增加了，达到整体逻辑级数的平衡。
Flink 中可以使用一套 API 完成对有界数据集以及无界数据的统一处理，而无界数据集的处理一般会伴随着对某些固定时间间隔的数据聚合处理。比如：每五分钟统计一次系统活跃用户、每十秒更新热搜榜单等等
Mysql 本文的示例在 Mysql 5.7 下都可以测试通过。 概念 数据库（database）：保存有组织的数据的容器（通常是一个文件或一组文件）。 数据表（table）：某种特定类型数据的结构化清单。 模式（schema）：关于数据库和表的布局及特性的信息。模式定义了数据在表中如何存储，包含存储什么样的数据，数据如何分解，各部分信息如何命名等信息。数据库和表都有模式。 列（column）：表中的一个字段。所有表都是由一个或多个列组成的。 行（row）：表中的一个记录。 SQL 基础 SQL（S
工程设置 文档网址连接 后台运行设置：接入底层库（Resource/PlatConfig.Asset/runInBackground） 安卓平台 Android 6.0 中的运行时权限参考Unity官网安卓设置 Dissonance包含与Android兼容的ARM64二进制文件，这些二进制文件仅在Unity 2018.1+中启用 镜像网络Mirror 前提：您必须使用支持不可靠联网（例如Ignorance）的网络后端。 步骤1： Dissonance Comms对象 DissonanceSetup.pre
在设计进入之前，需要根据设计规范进行设计规划。设计规范需要转换为体系结构和微体系结构。设计架构和微架构包括将总体设计分解为小模块，以实现预期功能。在架构设计阶段，需要估计内存、速度和功率的需求。根据需要，需要为实现选择FPGA设备。
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