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奇偶校验器设计(奇偶校验与奇偶检测,XOR法和计数器法|verilog代码|Testbench|仿真结果)

图片 --- --- 数字IC经典电路设计 经典电路设计是数字IC设计里基础中的基础,盖大房子的第一部是打造结实可靠的地基,每一篇笔者都会分门别类给出设计原理、设计方法、verilog代码、Testbench...2.2 verilog代码 //使用XOR法设计奇偶校验器 module parity_checker01( input clk, input rst_n...3.2 verilog代码 //使用计数器法设计奇偶校验器 module parity_checker02( input clk, input rst_n...begin even_bit <= 1'b0; odd_bit <= 1'b0; end else if(cnt[0] == 1'b1) begin //通过计数器最低位判断是否为偶数...Tips:判断计数器是奇数还是偶数主要有判断data_out0和取余数两种方法,前者综合后耗损的资源太多不推荐前者。

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