数字仿真是一种软件程序，它将逻辑值变化（称为激励）应用于数字电路模型的输入，以实际硅传播这些逻辑值变化的相同方式通过模型传播该激励，并提供观察和验证该激励结果的机制。
输入捕捉：具有此功能的一个管脚，定时器在内部时钟的作用下在运行，此时管脚来了个中断，假如上升沿吧。在中断的作用下，定时器停止工作，此时可以读出定时器的数值，读出后再开启定时器，等待下次中断，再读取一次定时器数值，二次相减，就可求出二次中断的间隔时间 输出比较：有一寄存器先存放你要定时的数，例如50.定时器在内部时钟下有0开始慢慢向上加，没加一次都会和那个寄存器比较，当等于那个寄存器值时 如50，此管脚就会跳变（输出一高电平或低电平） 以上摘自https://www.cnblogs.com/we1238/articles/7418933.html 捕获模式可以用来测量脉冲宽度或测量频率 简单说就是检测脉冲的边沿信号发生的时间（上升沿/下降沿），将当前定时器的值存到捕获寄存器中 ，完成一次捕获。 例如 ，我们可以先设置捕获上升沿，记录一次定时器值，然后设置下降沿，再记录一次定时器值，两次值之差就是高电平的脉宽，再根据计数频率就可以算出脉宽的具体时间 这可能只是捕获的基本用法 捕捉功能我看都是说两次上升沿或者两次下降沿的时间； 但是如何测量脉冲宽度呢？脉宽是：上升沿--》下降沿 的时间，难道 是先设置上升沿捕捉，等上升沿中断来，再设置下降沿捕捉？ 可以设置成同时捕捉上升下降沿，存起来再根据需要测宽度还是周期检测脉宽的宽度
在前一个教程PLC编程入门-梯形图中，我们学习了梯形图的基础知识以及一些基本的指令。在今天这个教程里，我们将学习如何采用梯形逻辑解决实际问题，以及如何进行PLC编程，同时我们还会学习一些新的梯形逻辑指令。
在SV中常用interface连接端口，它的好处在于，方便了在sv中模块声明中不需要一个个的写端口，直接在端口中实例化一个interface即可。接口中还可以包含任务函数、断言等等。说多了咱也记不住，就说这点吧。不过我觉得最好用的还是第一点哈。
本篇文章将与大家探讨USART波特率 vs SPI速率。这里提出一个问题，为什么USART的波特率是内核时钟的1/8或者1/16，而SPI最快的频率可以是内核时钟的1/2。
1：原点回归启动后，电机朝反向限位方向运转（第一段速），遇到反向限位后，电机向相反方向运行，检测到反向限位下降沿后运行至电机 Z 相停止（第二段速），当前位置被设置为 MC_Home_LXM28 功能块的 Position 数值（脉冲数）；运行时遇到正向限位后，电机停止，伺服驱动器显示 AL015 报警
在SIMATIC S7-1500和S7-1200 PLC中，选择编程语言为SCL时，可以看到TIA Portal软件自带两个指令分别用于检测信号的上升沿和下降沿，如图1所示：
据多年观察，【每日一题】是应届学生夯实基础、提高能力的最好方法之一，所以，我们特地整理了一些工作中认为应该熟知和掌握的技术问题，供学生朋友参考。（申明：以下问题不一定面试和笔试中会遇到，不是真题、押题和猜题，只是以学习和提高为目的。）
在一个8bit的变量中，从一个周期到另一个周期期间，检测输入信号变化。即上升沿变化或下降沿变化。输出应在0变为1后产生。
开漏输出一般应用在I2C、SMBUS通信等需要“线与”功能的总线电路中。除此之外，还用在电平不匹配的场合，如需要输出5V的高电平，就可以在外部接一个上拉电阻，上拉电源为5V，并且把GPIO设置为开漏模式，当输出高阻态时，由上拉电阻和电源向外输出5V的电平,如下图
一般情况下，Verilog HDL源程序中所有的行都将参加编译。但是有时希望对其中的一部分内容只有在满足条件才进行编译，也就是对一部分内容指定编译的条件，这就是“条件编译”。有时，希望当满足条件时进行编译，而当条件不满足是则编译另一部分。
大侠好，欢迎来到FPGA技术江湖，江湖偌大，相见即是缘分。大侠可以关注FPGA技术江湖，在“闯荡江湖”、"行侠仗义"栏里获取其他感兴趣的资源，或者一起煮酒言欢。
AVdd ： 供电范围2.7-5.5v CLR : 异步清除输入，下降沿有效，触发后，DAC8562输出最低电压值，DAC8563输出中间值。用户写入操作的的第24个时钟下降沿将退出清除模式，激活清除模式将终止写操作。 Din ：串行时钟输入，每个时钟下降沿将数据写到的24bit的输入移位寄存器。 GND : 接地端。 LDAC : 同步模式下，数据更新发生在第24个SCLK周期的下降沿，之后伴随着SYNC的下降沿。 这种同步更新不需要LDAC，而LDAC必须永久接地，或者将命令发送到设备时保持低电平。 异步模式下，LDAC是低电平触发，用于同步DAC更新，可以编写多个单通道命令进行设置，然后在LDAC引脚上产生一个下降沿将同步更新DAC输出寄存器 SCLK : 时钟输入端，支持50MHz。 SYNC : 低电平有效，当SYNC变为低电平时，它使能输入移位寄存器，并且数据采样在随后的时钟下降沿。 DAC输出在第24个时钟下降沿之后更新。 如果SYNC在第23个时钟沿之前变高，SYNC的上升沿将充当中断，并且DAC756x，DAC816x和DAC856x器件将忽略写序列。 VoutA : 模拟电压输出A。 VoutB : 模拟电压输出B。 Vrefin/Vrefout ： 双向电压参考引脚，如果内部电压基准，此引脚是输出2.5V。 4、输出电压计算公式：
Accellera的便携式测试和激励标准提供了强大的验证功能，这些功能并不能代替UVM，而是可以增加现有的验证流程。这就是便携式激励和UVM相互作用的方式。
STA的准备工作包括：设定时钟、指定IO时序特性、指定false path和multicycle path
为了写一篇文章做铺垫--提醒着自己,,,,,, 这两天一直在寻找 #pragma vector = PORT1_VECTOR __interrupt void P1_Interrupt()//P1口中断函数 { } 对于这两句话的解释,最起码让自己感觉能说服自己 看了好多后自己的理解 #pragma vector = PORT1_VECTOR 通俗来讲这句话是告诉C编译器,你下面的函数是P1口的中断函数,P1口有中断发生时就进入下面这个函数 __interrupt void P1_Interrupt(
DVIIN1_CLK为输入视频源的随路时钟，用于检测分辨率的时钟，行分辨率的检测从视频源的数据有效信号DVIIN1_DE的上升沿开始计数，直到DVIIN1_DE的下降沿对HsNum锁存输出。列分辨率的检测的是一个DVIIN1_HS有效期间检测DVIIN1_DE的上升沿或者下降沿个数（实现方式如下），然后在DVIIN1_HS的下降沿将VsNum锁存输出。
建立时间和保持时间的理解都是基于D触发器，关于D触发器可以翻看数电的介绍。或者通过下面的链接了解：https://zh.wikipedia.org/wiki/%E8%A7%A6%E5%8F%91%E5%99%A8
在单片机与嵌入式开发中，某些场景需要捕获传感器的高电平（或低电平）信号的持续时间，如红外解码信号、编码器输入信号等。
SPI由于接口相对简单（只需要4根线），用途算是比较广泛，主要应用在 EEPROM，FLASH，实时时钟，AD转换器，还有数字信号处理器和数字信号解码器之间。即一个SPI的Master通过SPI与一个从设备，即上述的那些Flash，ADC等，进行通讯。而主从设备之间通过SPI进行通讯，首先要保证两者之间时钟SCLK要一致，互相要商量好了，要匹配，否则，就没法正常通讯了，即保证时序上的一致才可正常讯。而这里的SPI中的时钟和相位，指的就是SCLk时钟的特性，即保证主从设备两者的时钟的特性一致了，以保证两者可以正常实现SPI通讯。
概述： 通过两个MCU（STM32F103）来模拟SPI的主从机，完成主机发送从机接收，便于理解SPI协议。
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经典电路设计是数字IC设计里基础中的基础，盖大房子的第一部是打造结实可靠的地基，每一篇笔者都会分门别类给出设计原理、设计方法、verilog代码、Testbench、仿真波形。然而实际的数字IC设计过程中考虑的问题远多于此，通过本系列希望大家对数字IC中一些经典电路的设计有初步入门了解。能力有限，纰漏难免，欢迎大家交流指正。快速导航链接如下：
有客户在使用reACTION技术时，可能采用之前的脉冲发生器的方案，同时可能需要闭环检测是否执行，因此在同一个脉冲模块上即要做脉冲输出，又要使用脉冲检测。
我们知道，Verilog中，有两种基本的数据类型：reg和wire，reg在always、initial、task和funciton中被赋值，wire使用assign赋值。
本系列将带来FPGA的系统性学习，从最基本的数字电路基础开始，最详细操作步骤，最直白的言语描述，手把手的“傻瓜式”讲解，让电子、信息、通信类专业学生、初入职场小白及打算进阶提升的职业开发者都可以有系统性学习的机会。
闲来无事，想了想写点东西，顺带着记录一下自己学习的过程，其中千兆以太网这个模块是之前的一个项目任务，已经实现，但是想着自己在这里面也遇到过许多坑，所以写点东西，避免后来者遇到相同的问题，以后尽量避免事后总结，要做到边做边总结；
上个章节我们讲解了spi接口定义，今天我们更加深入讲解下spi协议时序图和spi四种模式的用法。
BSV 是一门高级硬件描述语言（High-Level Hardware Description Language, HL-HDL），与 Verilog 一样，被用于 FPGA 或 ASIC 的设计和验证。BSV 于 2003 年被 Bluespec 公司开发，期间是商业收费工具，到 2020 年它的编译器才开源，这才给了我们接触它的机会。
遥控器，做为和物联网设备通信的设备之一，用途还是蛮多的。毕竟像遥控器这类设备，成本低，功能强，一次可以满足多种需要。所以，这一节，咱们研究下用ESP8266，连接一体式红外接收头，然后做红外解码的用法。
我们用3个包含触发器和多路选择器的子模块来实现图中电路。题目要求我们写出包含一个触发器和一个多路选择器的子模块。
SPI全称为Seriel Peripheral Interface (串行外设接口)，是 MCU 中常用的外设接口。SPI 通信原理很简单，它是以主从方式进行工作，通常有一个主设备和一个或多个从设备，至少需要4根线（支持全双工）工作，分别为 MISO（主入从出），MOSI（主出从入），SCLK（时钟），SS（片选）。
模块定义包括一个端口列表，该列表用括号括起来。端口用于将数据传入或传出模块。模块可以有四种类型的端口：输入、输出、双向输入输出和接口（input，output, bidirectional inout，和 interface）。输入、输出和输入输出端口是离散端口，其中每个端口通信一个值或用户定义的类型。接口端口是复合端口，可以通信多个值的集合。本文介绍离散端口的语法和使用指南。后续将介绍接口端口。
51系列单片机的中断共有5个，其中外部中断共占两个。外部中断主要通过单片机的引脚P3.3、P3.4接收外部脉冲或高低电平触发CPU中断。与外部中断有关的多功能寄存器为IE、IP、TCON。
https://baike.baidu.com/item/%E7%A7%92/2924586
上篇电机控制基础——定时器捕获单输入脉冲原理介绍了定时器捕获输入脉冲的原理，那种方式是根据捕获的原理，手动切换上升沿与下降沿捕获，计算脉冲宽度的过程原理比较清晰，但编程操作起来比较麻烦。
外部中断一般用于接收外部特殊电平，比如红外线解码、倒车雷达（超声波）等其他外部信号，STM32的每个GPIO口都支持中断功能，上本文基于按键讲述外部中断功能。
RAII是Resource Acquisition Is Initialization的缩写，即 “资源获取即初始化”。
参考资料：《STM32F10X-中文参考手册》中断和事件章节 《野火STM32手册》
当电源控制器看到 suspend_detected 被激活（并且在状态寄存器中设置了电源门控启用位）时，它会启动掉电序列。该序列如图 8-2 所示，描述如下：
项目专栏：https://blog.csdn.net/m0_38106923/category_11097422.html
SPI是串行外设接口的缩写，是一种高速的，全双工，同步的通信总线。由于SPI高速和同步的特性，使其成为嵌入式系统和小型设备中使用最广泛的几种通信接口之一。本文将详细讲解一下SPI，并且最后基于STM32编写一个例程。
这个图是哔哩哔哩上面up主（Bernice_坚果丁）提供的，感觉不错，自己曾经也用过掉电保护，只是功能电路不一样，因此记录学习一下。
数字门级电路可分为两大类：组合逻辑和时序逻辑。锁存器是组合逻辑和时序逻辑的一个交叉点，在后面会作为单独的主题处理。
Hello everybody，我们接着上期的Process（1）-产生进程的方式（点击跳转）继续讲解SystemVerilog中对于process的多种控制方式。
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