如何做好芯片复位？

从0到1不容易，Reset也是。

这是一份关于芯片复位(reset)的问题列表，涉及前端、后端、测试、系统应用等方面。没有答案。欢迎大家一起讨论，也期待各位大牛给出答案，以及更多更好的问题。

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复位的作用

初始化：比如上电后给计数器一个初始值。

出错恢复：比如watchdog可以监测系统出错进行复位。

1.1是否所有包含存储/记忆功能的电路都需要复位？

1.2DFF如果不复位，输出电平是确定值吗？

1.3Latch需要复位吗？

1.4on-chip SRAM没有复位电路，上电后初始值是什么？

2

同步/异步复位

依赖时钟才能复位的是同步复位

不依赖时钟的是异步复位

verilog写法如下:

2.1异步复位和同步复位的1个DFF哪个面积大？

2.2异步复位和同步复位各有什么优缺点？

2.3“异步复位，同步释放” （reset synchronizer）

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复位信号从哪里来

外部复位

电源复位

watchdog复位

software复位

JTAG调试复位

3.1外部复位信号如何去除glitch？

3.2复位的PAD类型如何选择？

3.3上电复位(POR)的时间要多久？

3.4需要几路POR？

3.5低压/掉电复位监测需要多少档位？

3.6watchdog的时钟用哪一个？什么时候开启?

3.7需要多少个软件复位控制接口?

3.8JTAG复位如何跨时钟域？

4

复位网络

4.1复位信号有优先级吗？

4.2是电平有效还是脉冲有效？低有效还是高有效？

4.3不同复位信号控制的模块如何划分？

4.4复位需要保持有效多长时间才能确保整个系统完成复位?（尤其是有多个时钟域的情况下）

4.5clock gating控制信号与复位信号之间的关系？

4.6多级reset-sync-cell级联要注意哪些问题？

5

复位响应

复位信号有效后，要考虑系统的行为。

5.1电源和时钟是否稳定了？ 什么情况下可以立即复位？

5.2cpu要做什么处理？

5.3memory的数据怎么办？

5.4如果在系统启动、程序下载、或者中断处理等特殊时刻发生复位如何处理？

5.5通信接口复位之后会处于什么状态？

5.6人机交互接口复位要考虑哪些问题？比如显示接口，声音接口，传感器接口。

6

DFT处理

6.1SCAN/BSD/MBIST/Lab test mode需要单独的复位信号吗？

6.2增加DFT bypass模式的reset-sync-cell？

6.3reset-sync-cell的DFF要做扫描吗？对测试覆盖率有什么影响？

6.4双向IO做复位输入，边界扫描如何处理？

7

综合与后端

7.1输入复位信号的时序约束:set false path 还是set_input_delay 0 -clock xx？

7.2综合需要设置复位 ideal network，dont_touch_network吗？

7.3后端要给reset做tree吗(CTS)？如何分析异步 RESET 信号树的 SKEW？如何平衡skew和fanout？

7.4什么样的reset信号可以set_false_path？

7.5如何进行复位信号的时序和噪声分析?

7.6reset sync cell的时序如何分析?

8

测试

8.1lab test(bring up)需要哪些特殊的调试复位信号？

8.2ATE不同测试项之间需要什么样的复位？如何节省测试时间成本？

8.3如何测试系统复位的有效性和可靠性？

8.4电源相关的复位如何测试?

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FPGA

9.1怎样使用GSR全局信号？

9.2做产品的FPGA代码不建议复位?

9.3做SOC/ASIC验证如何移植代码到FPGA？

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模拟IP

10.1模拟IP需要复位电路吗？

10.2数模混合仿真的复位过程？

11

验证

11.1reset功能如何实现随机化测试？

11.2如何进行寄存器复位初值测试?

11.3如何利用静态分析工具找出复位的设计问题？

11.4后仿中的x状态哪些与复位有关?应该如何处理? reset sync cell的时序违背可以忽略吗？

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软件复位

12.1软件复位之后要等多久？

12.2复位过程中程序内存的状态？

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低功耗

13.1如何实现不同电源域的复位处理?

13.2复位模式下功耗有多少? 复位释放之后是否会由于多个电路同时启动发生瞬间的大电流?

13.3唤醒之后是否需要复位操作?

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常见复位错误

14.1没有正确使用异步reset sync cell

14.2复位时间不足（复位不完全）

14.3复位与电源、时钟和其他复位信号之间的相互依赖形成死锁

14.4同一信号既用作同步复位，也用作异步复位

14.5复位信号控制的模块过多或过少

14.6复位信号电源域出错

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可靠性设计

15.1如何设计可靠的复位系统？要考虑哪些干扰因素，有哪些措施？

15.2如何设计一个不需要复位的稳定系统？不知道是否可行？

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关于Reset设计的资料（前端必读）

1Asynchronous & Synchronous Reset Design Techniques - Part Deux

http://t.cn/RmgMH4S

2Reset Testing Made Simple with UVM Phases

http://t.cn/RmgMefL

3Reset verificaiton in soc design

http://suo.im/4qSffk