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JVM Advanced JIT Compiler Options

-XX:AllocatePrefetchLines=lines 使用JIT编译代码中生成指令,在最后一个对象分配之后加载的缓存行数。 -XX:AllocatePrefetchStyle=style 为指令生成代码样式。 0 -无指令产生d, 1 -每次分配后执行指令, 2 -执行指令时,使用TLAB分配标记指针到gate。 可以使用-XX:LogFile选项指定不同的日志文件路径和名称。 默认情况下,禁用此选项,不记录编译活动。 因此,处理器重复地使其他处理器的缓存线路无效,这迫使它们从主内存中读取,而不是从缓存中读取。

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☀️ 学会编程入门必备 C# 最基础知识介绍(六)——接口、命名空间、预处理指令、正则表达式、异常处理、文件的输入与输出

定义命名空间 using 关键字 嵌套命名空间 C# 预处理器指令???? C# 预处理器指令列表 #define 预处理器 条件指令 C# 正则表达式???? using 命名空间指令,这样在使用的时候就不用在前面加上命名空间名称。 该指令告诉编译器随后的代码使用了指定命名空间中的名称。下面的代码演示了命名空间的应用。 预处理器指令指导编译器在实际编译开始之前对信息进行预处理。 所有的预处理器指令都是以 # 开始。且在一行上,只有空白字符可以出现在预处理器指令之前。预处理器指令不是语句,所以它们不以分号(;)结束。 ---- #define 预处理器 #define 预处理器指令创建符号常量。 #define 允许定义一个符号,这样,通过使用符号作为传递给 #if 指令的表达式,表达式将返回 true。

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    基于DPDK(x86平台)应用性能优化实践

    数据结构设计 成员变量从大到小排列,避免过多的padding。 可以在定义数据结构时用宏__rte_cache_aligned或加入padding成员。 一般访问CPU的cache效率最高,提前将需要处理的数据load到cache可以提高性能,但取必须在合适的时间点发起,过早发起取会导致数据还没有被使用就被替换出cache,最终适得其反,所以需要根据实际应用场景和多次尝试找到最合适的取时间点 Intel处理器内部有许多事件计数器,当有事件发生时对应的计数器加一,与程序性能相关的计数器有如下几种: cache misses 分支预测错误 DTLB misses 长延时指令和异常 通过查看这些计数器值大小便可断定瓶颈原因 执行amplxe-cl,指定采集类型和目标程序,开始采集数据,运行结束后会在当前目录下生成类似r000hs名称的目录,里面存放的是收集的结果 .

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    Intel P4 CPU

    在AMD的处理器中,通常采用译码( Predecode)的方式来解决这个难题,指令从内存读入到 Cache中时,就开始解码,得出译码标识,译码标识包括指令的起始位置、需要译出的uop数目、操作码等信息 译码标识连同指令一起存储在指令 Cache中,在正式译码时工作难度就减轻了。 Inte的处理器则采用多级译码流水线的方式来实现译码。 当一条CISC指令生成的uop数目多于4条时,就将这些CISC指令对应的uop存储在 micro-ROM(uROM)中,解码时使用査表的方式从 micro-ROM中得到,这样就简化了复杂指令的译码过程。 除了这些基本的模块之外,处理器在根据地址取指令时,需要进行虚地址、实地址转换,使用到TLB( Translation Lookaside Buffer);P4处理器中,有两个分支预测单元,一个用于预测指令的执行路径 然后uop会被寄存器重命名,在p4处理器中,8个通用寄存器能使用128个物理寄存器,逻辑寄存器和物理寄存器之间的映射关系被保存在RAT( Register Alias Table)中。

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    并发乱序执行

    这种做法存在风险: 标志位先被写入, 但是之前的数据操作并未完成 (可能未计算完成, 也可能是数据没有从 CPU 缓存刷新到主存), 最终导致了另外一个核使用了错误的数据. 处理器的分支预测单元有可能直接把两条分支指令取过来并发执行, 等到分支判断的结果出来后, 再丢弃掉错误的数据. a=b+c if(a>0){    p=x+y }else{    p=x-y; } 代码的本意是先计算 编译器乱序优化 ------- 受到处理器取单元的能力限制,处理器每次只能分析一小块指令的并发性,如果指令相隔比较远就无能为力了。 但是从编译器的角度来看,编译器能够对很大一个范围的代码进行分析,能够从更大的范围内分辨出可以并发的指令,并将其尽量靠近排列让处理器更容取和并发执行,充分利用处理器的乱序并发功能。 所以在打开编译器优化以后,看到生成的汇编码并不严格按照代码的逻辑顺序是正常的。

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    PCI Express 系列连载篇(十五)

    读机制 软件读 软件读机制由来已久,首先实现指令处理器是Motorola的88110处理器,这颗处理器首先实现了“touch load”指令,这条指令是PowerPC处理器dcbt指令[5] 后来绝大多数处理器都采用这类指令进行软件读,Intel在i486处理器中提出了Dummy Read指令,这条指令也是后来x86处理器中PREFETCHh指令[6]的雏形。 Cache中,但是这个数据块b首次被处理器使用,此时也将数据块b+1读到Cache中;如果数据块b已经在Cache中,但是这个数据块b已经被处理器使用过,此时不将数据块b+1读到Cache中。 [3] PowerPC处理器使用dcbt指令,而x86处理器使用PREFETCHh指令,实现这种软件读。 [4] 假定从Cache中获得数据需要一个时钟周期。 [5] dcbt指令是PowerPC处理器的一条存储器指令,该指令可以将内存中的数据读到L1或者L2 Cache中。 [6] PREFETCHh指令是x86处理器的一条存储器指令

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    嵌入式 C 语言(中)

    在C语言中可以使用枚举类型声明符号名称来表示整型常量,使用enum关键字可以创建一个新的“类型”并指定它可具有的值(实际上,enum常量是int类型,因此只要能使用int类型的地方就可以使用枚举类型)。 使用typdef时要记住,typedef并没有创建任何新类型,它只是为某个已有的类型增加了一个方便使用的标签。 预处理器与预处理指令 本节将简单介绍C语言的预处理器及其预处理指令。 C语言建立在适当的的关键字、表达式、语句以及使用他们的规则上。然而C标准不仅描述C语言,还描述如何执行C预处理器。 C预处理器在执行程序之前查看程序,因而被称之为预处理器。 根据程序中的预处理指令,预处理器把符号缩写替换成其表示的内容(#define)。预处理器可以包含程序所需的其它文件(#include),可以选择让编译器查看哪些代码(条件编译)。 文件包含#include 当预处理器发现#include预处理指令时,会查看后面的文件名并把文件的内容包含到当前文件中,即替换文件中的#include指令

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    Android 混淆那些事儿

    混淆不仅能将代码中的类名、字段、方法名变为无意义的名称,保护代码,也由于移除无用的类、方法,并使用简短名称对类、字段、方法进行重命名缩小了程序的size。 在压缩阶段,Proguard从上述Entry Points开始遍历搜索哪些类和类成员使用。其他没有被使用的类和类成员会移除。 在混淆阶段,Proguard重命名非Entry Points的类和类成员检阶段是唯一没有触及Entry Points的阶段。 下图为使用命令行最简单的方法生成资源混淆的apk,下载github工程后,进入tool_output文件夹,试验的apk为test.apk java -jar AndResGuard-cli-1.2.3 ,如下面代码所示,在AAPT生成resources.arsc和*.ap*时把资源文件的名称进行替换。

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    ProGuard混淆

    2.优化(optimizes):对字节码进行优化,移除无用的指令。 3.混淆(obfuscates):使用a,b,c,d等简短而无意义的名称,对类,字段和方法进行重名,这样即使代码被逆向工程,对方也比较难以读懂。 混淆的时候大量使用重载,多个方法名使用同一个混淆名(慎用) -useuniqueclassmembernames:确定统一的混淆类的成员名称来增加混淆。 检测 -dontpreverify 执行ProGuard后会生成的文件: 1)dump.txt 描述apk文件里的所以类的内部结构 2)mapping.txt 列出了原始的和混淆后的类 # 有了verbose这句话,混淆后就会生成映射文件 -verbose # 包含有类名->混淆后类名的前后映射关系, 然后使用printmapping指定映射文件的名称 -printmapping

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    漫谈C变量——对齐 (1)

    这类处理器有,Cortex-M3/M4/M7... ----   一方面,我们常说,物质基础决定上层建筑,为处理器服务的编译器自然是把处理器的脾气摸的清清楚楚;另一方面,为了让自己生成的代码体现最大限度的兼容性 ,即便是为Cortex-M3/M4这样支持非对齐操作的处理器服务,编译器也会默认按照仅支持对齐操作的情况来生成代码。    进一步来说,ARM Cortex-M 是一个Load/Store 架构(看到L/S的同学不要激动,这和打游戏的L/S大法半毛钱关系都没有),意思是说,处理器的所有算术逻辑运算都只能使用寄存器页中的内容( Cortex-M 处理器支持哪些Load/Store指令呢? (这里,指令的缩写和名称不用记忆,只需要知道支持针对哪些数据类型的Load/Store指令即可) LDR, LoaD Word to Register 读取单个Word到指定寄存器的指令 STR, STore

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    深入理解volatile的内存语义内存可见性禁止重排序

    一旦一个共享变量(类的成员变量、 类的静态成员变量) 被 volatile 修饰之后, 那么就具备了两层语义: 保证了不同线程对这个变量进行读取时的可见性, 即一个线程修改了某个变量的值, 这新值对其他线程来说是立即可见的 内存可见性 第一: 使用 volatile 关键字会强制将修改的值立即写入主存; 第二: 使用 volatile 关键字的话, 当线程 2 进行修改时, 会导致线程 1 的工作内存中缓存变量 stop 为了实现 volatile 的内存语义, 加入 volatile 关键字时, 编译器在生成字节码时, 会在指令序列中插入内存屏障, 会多出一个 lock 前缀指令。 内存屏障是一组处理器指令, 解决禁止指令重排序和内存可见性的问题。 编译器和 CPU 可以在保证输出结果一样的情况下对指令重排序, 使性能得到优化。 , 当处理器发现自己缓存行对应的内存地址被修改, 就会将当前处理器的缓存行设置成无效状态, 当处理器要对这个数据进行修改操作的时候, 会强制重新从系统内存里把数据读到处理器缓存里 2.它确保指令重排序时不会把其后面的指令排到内存屏障之前的位置

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    Java的volatile

    原理 实现机制 volatile修饰的共享变量进行写操作的时候会多出Lock前缀的指令(具体的大家可以使用一些工具去看一下,这里我就只把结果说出来)。 那么Lock前缀的指令在多核处理器下会发现什么事情了? 因此,经过分析我们可以得出如下结论: 1.Lock前缀的指令会引起处理器缓存写回内存; 2.一个处理器的缓存回写到内存会导致其他处理器的缓存失效; 3.当处理器发现本地缓存失效后,就会从内存中重读该变量数据 如何阻止重排序 为了实现volatile内存语义时,编译器在生成字节码时,会在指令序列中插入内存屏障来禁止特定类型的处理器重排序。 可用Atomxx原子类 对象的任何非原子成员调用(包括成员变量和成员方法)不是原子的。

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    Objective-C中的预处理器指令与宏

    引 什么是预处理器,跟我有什么关系? 预处理器是在OC源文件编译过程中的一个部分,而且是第一个处理部分,预处理器也由此可见。 整个编译过程可以大致分为:预处理器进行词法分析 -> 语法分析 -> 生成代码和优化 -> 生成可执行的二进制文件。 既然有这么多过程,为什么要关注预处理器呢? 不信的话我们可以列举一下常见的预处理指令,预处理器有其区别于Objective-C的独特语法,语法形式如下: #指令指令参数 有点眼熟了? 除了上述的指令外,还有一个老熟人也属于预处理器的范畴,下文再来说。 #pragma指令 这个指令更常见了,我们使用UITableView的时候,经常会用到: #pragma mark - UITableView DataSource …… #pragma mark -

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    .NET机器学习 ML.NET 1.4预览版和模型生成器更新

    使用的第一个新功能是新的硬件内在功能,它允许.NET代码通过使用特定于处理器指令来加速数学运算。 SSE指令允许在单个指令中处理四个32位浮点数。现代的基于x86的处理器还支持AVX指令,允许在一条指令中处理8个32位浮点数。 ML.NET的C#硬件内在函数代码支持AVX和SSE指令,并将使用最好的指令。 这意味着在现代处理器ML.NET上进行培训 现在将训练更快,因为它可以执行更多的并发浮点操作,而不是只支持SSE指令的现有C ++代码。 改进了对其他OS 本地化的支持 这解决了许多经常报告的问题,开发人员希望使用他们自己的本地化操作系统设置来训练模型生成器中的模型。请阅读此问题以获取更多详细信息。

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    面向对象(三十三)-预处理指令

    什么是预处理指令处理器指令指导编译器在实际编译开始之前对信息进行预处理。 预处理指令注意点 所有的预处理器指令都是以 # 开始。且在一行上,只有空白字符可以出现在预处理器指令之前。 预处理器指令不是语句,所以它们不以分号(;)结束。 C# 编译器没有一个单独的预处理器,但是,指令被处理时就像是有一个单独的预处理器一样。在 C# 中,预处理器指令用于在条件编译中起作用。 Console.WriteLine("这里编译前会抛出警告,可以将开发中一些不确定的代码块写一下注释"); #line #line 使您可以修改编译器的行号以及(可选)错误和警告的文件名输出 #line 指令可能由生成过程中的自动中间步骤使用 此选项也可用来使 ASP.NET 能够区分用户定义的代码和计算机生成的代码。尽管 ASP.NET 是此功能的主要使用者,但很可能将有更多的源生成使用它。 #line filename 指令指定您希望出现在编译器输出中的文件名。默认情况下,使用源代码文件的实际名称。文件名必须括在双引号 ("") 中。 源代码文件可以具有 #line 指令的任何编号。

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    java并发编程实战(4) volatile实现原理四、volatile的适用场景

    下面我们看一段代码,并将代码生成处理器的汇编指令打印出来(关于如何打印汇编指令,我会在文章末尾附上),看下对volatile变量进行写操作时,CPU会做什么事情: public class VolatileTest lock指令在多核处理器下会引发下面的事件: 将当前处理器的缓存行的数据写回到系统内存,同时使其他CPU里缓存了该内存地址的数据置为无效。 指令重排序包括编译器和处理器重排序,JMM会分别限制这两种指令重排序。 那么禁止指令重排序又是如何实现的呢?答案是加内存屏障。 线程 2 被线程 1 占。 线程 1 通过运行 Singleton 对象的构造函数并将引用返回给它,来完成对该对象的初始化。 在 volatile bean 模式中,JavaBean 的所有数据成员都是 volatile 类型的,并且 getter 和 setter 方法必须非常普通——即不包含约束!

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    使用嵌入式SQL(一)

    列出的“ SQL语句”位置是包含嵌入式SQL代码的例程的名称。请注意,执行嵌入式SQL不会在“缓存的查询”列表中生成一个条目。 #SQLCompile宏指令宏预处理器提供了三个与嵌入式SQL一起使用的预处理器指令: #SQLCompile Select指定从Select语句返回时数据显示的格式,或者指定插入或更新语句时数据输入所需的格式 Studio可以识别&sql指令,并使用可识别SQL的着色器对SQL代码语句进行语法着色。当宏预处理器遇到&sql指令时,它将随附的SQL语句交给SQL查询处理器。 在Studio中,可以根据需要查看生成的代码,方法是查看为类或例程生成的INT代码(使用“查看”菜单中的“查看其他代码”选项)。 如果&sql指令包含无效的Embedded SQL语句,则宏预处理器生成编译错误。无效的SQL语句可能具有语法错误,或者引用了在编译时不存在的表或列。

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    Proguard 常用规则

    需要保留注释的类成员生成的类和实用程序类 -keepclassmembers,allowobfuscation class * { @dagger.** *; } -keep -useuniqueclassmembernames 指定将相同的混淆名称分配给具有相同名称的类成员,并将不同混淆名称分配给名称不同的类成员(对于每个给定的类成员签名)。 这些属性可以用一个或多个-keepattributes指令来指定。 可选过滤器是Java虚拟机和ProGuard支持的属性名称的逗号分隔列表。 属性名称可以包含? 请注意,该属性必须首先出现,所以它也必须使用-keepattributes指令明确保留。 例如,您可能希望让处理过的库和应用程序生成有用的混淆堆栈跟踪。 对于Java Micro Edition,需要进行验证,因此如果指定此选项,则需要在处理的代码上运行外部验证程序。 对于Java 6,验证是可选的,但从Java 7开始,它是必需的。

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    关于 Java 关键字 volatile 的总结

    重排序是指编译器和处理器为了优化程序性能而对指令序列进行排序的一种手段。 在线程A执行这段赋值语句,在初始化分配对象之前就已经将其赋值给 instance 引用,恰好另一个线程进入方法判断 instance 引用不为 null,然后就将其返回使用,导致出错。 3.3 禁止指令重排的原理 volatile 关键字提供内存屏障的方式来防止指令被重排,编译器在生成字节码文件时,会在指令序列中插入内存屏障来禁止特定类型的处理器重排序。 } } return instance; } } 4 保证内存可见性 4.1 什么是保证内存可见性 Java 支持多个线程同时访问一个对象或者对象的成员变量 ,由于每个线程可以拥有这个变量的拷贝(虽然对象以及成员变量分配的内存是在共享内存中的,但是每个执行的线程还是可以拥有一份拷贝,这样做的目的是加速程序的执行,这是现代多核处理器的一个显著特性),所以程序在执行过程中

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    ARM汇编语言指令集汇总

    PLI 指令 RFE 从异常中返回 SRS 存储返回状态 LDREX 和 STREX 独占加载和存储寄存器。 指令 简介 CDP 协处理器数据处理操作 CDP2 协处理器数据处理操作 MCR、MCR2、MCRR 和 MCRR2 从寄存器移动到协处理器 LDC、LDC2、STC、STC2 在内存和协处理器之间传送数据 32 位常数或地址载入寄存器(无范围限制,但与位置相关) UND 生成无体系结构定义的指令。 位清零指令 BIC R0,R0,#%1011 该指令清除 R0 中的位 0、1、和 3,其余的位保持不变 BKPT 断点,当指令到达某个特定地址处时,使用指令来检查系统状态 MRS 将 PSR 的内容移到通用寄存器中 ,MRS{cond} Rd, psr MSR 将通用寄存器的立即数或内容加载程序状态寄存器 (PSR) 的指定位段中 CPS 更改处理器状态,只允许在特权模式下使用 SMC 安全监控调用 SMC{cond

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