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1
回答
使用
预
处理器
指令
生成
成员
名称
?
c++
、
c
、
preprocessor-directive
我想实现以下目标,但我做不到: struct SamplerState int i;#define SAMPLER_MODE_U ClampU#define SAMPLER_NAME( a, b, c ) ( ##a ##_ ##b ##_ ##c){
浏览 31
提问于2021-03-01
得票数 1
回答已采纳
4
回答
如何编写在现代x64
处理器
上高效运行的自修改代码?
assembly
、
64-bit
、
intel
、
dispatch
、
self-modifying
目标是利用
处理器
的高效调用/ret预测,以避免中断。这个方法在这里有很好的描述:对当前缓存在
处理器
中的代码段中的内存位置的写入导致关联的缓存行(或多行)失效。此检查基于
指令
的物理地址。此外,P6系列和奔腾
处理器
检查对代码段的写入是否可以修改已
预
取以执行的
指令
。如果写入影响
预
取
指令
,则
预
取队列无效。后一种检查是基于
指令
的线性地址。
浏览 7
提问于2013-07-19
得票数 14
2
回答
从TextTransform.exe获取参数值到模板中
t4
、
template-engine
当我
使用
-a从模板
生成
代码时,我找不到如何
使用
参数TextTransform.exe的例子。在中,对参数-a的描述如下: 我需要在模板中设置一些参数,比如连接字符串等等。我的想法是借助参数-a获得配置文件的路径。
浏览 1
提问于2009-08-03
得票数 9
回答已采纳
3
回答
英特尔酷睿2双核
预
取
assembly
、
prefetch
、
blas
有没有人有
使用
Core 2 Duo
处理器
预
取
指令
的经验? 我一直在
使用
(标准?)
预
取设置(prefetchnta,prefetcht1等)成功用于一系列P4机器,但当在Core2 Duo上运行代码时,prefetcht(i)
指令
似乎什么也不做,并且prefetchnta
指令
效率较低英特尔是否引入了新的
预
取
指令
?
浏览 2
提问于2009-11-16
得票数 5
3
回答
为什么ARM异常中
预
取中止和数据中止的返回地址不同?
exception
、
arm
对于
预
取,返回地址是: R14_abt =中止
指令
的地址+4 对于数据中止,返回地址是: R14_abt =中止
指令
的地址+8
浏览 4
提问于2011-06-09
得票数 7
2
回答
ARM7 TDMI未定义
指令
异常手动
生成
exception
、
exception-handling
、
arm
、
opcode
我正在尝试测试一些运行在ARM7 TDMI
处理器
上的异常处理代码。我想手动创建一个
指令
操作码,它将
生成
“未定义的
指令
”异常。= 0x26889912; // bad opcode}有没有人知道如何轻松地创建它? 我只想验证我对这个异常
浏览 1
提问于2012-08-08
得票数 1
2
回答
我能控制什么被复制到C++中的CPU缓存中吗?
c++
、
memory-management
、
cpu-cache
我阅读了C++中的缓存优化以及现代CPU用来预测下一步需要哪些数据的机制,以便将这些数据复制到缓存中。但是,对于那些知道下一步实际需要什么的程序员来说,C++中是否有一种直接的方法来确定哪些数据被复制到CPU缓存中呢?
浏览 1
提问于2013-08-07
得票数 3
回答已采纳
1
回答
如何确定SSE
预
取
指令
大小?
cpu-architecture
、
sse
、
prefetch
我正在
使用
包含SSE
预
取
指令
内联程序集的代码。预
处理器
常量确定是否
使用
32-、64-或128-拜
预
取
指令
.该应用程序在多种平台上
使用
,到目前为止,我不得不对每一种情况进行研究,这是给定CPU的最佳选择。据我所知,这是缓存线的大小。
浏览 2
提问于2009-09-04
得票数 3
4
回答
Intel:串行化
指令
和分支预测
assembly
、
intel
、
cpu-architecture
、
branch-prediction
(Vol3A,第8-26节)说: *为澄清而编辑
浏览 6
提问于2011-11-18
得票数 2
回答已采纳
1
回答
Win32_Processor.ProcessorId的格式是什么?
visual-c++
我试图
生成
随机的ProcessorId,为了做到这一点,我需要弄清楚它的格式。对于x86类CPU,字段格式取决于CPU
指令
的
处理器
支持。如果支持该
指令
,则该属性包含2(2) DWORD格式化值。第一个是08h-0Bh的偏移量,它是CPUID
指令
返回的EAX值,输入EAX设置为1;第二个偏移量为0Ch-0Fh,这是
指令
返回的EDX值。此值来自SMBIOS信息中
处理器
信息结构的
处理器
ID
成员
。 有人能深入解释一下Win32_Proc
浏览 0
提问于2018-10-28
得票数 0
2
回答
如何
预
取不常用的代码?
c++
、
low-latency
、
prefetch
我想把一些代码
预
取到
指令
缓存中。代码路径不经常
使用
,但我需要它在
指令
缓存中,或者至少在极少数
使用
它的情况下在L2中。我对这些罕见的案例有一些预先的通知。_mm_prefetch是否适用于代码?
浏览 1
提问于2013-04-25
得票数 4
回答已采纳
4
回答
ARM上的
预
取
指令
c++
、
arm
、
assembly
较新的ARM
处理器
包括PLD和PLI
指令
。如何在C++代码中包含显式
预
取
指令
?
浏览 5
提问于2008-09-17
得票数 4
回答已采纳
1
回答
在不同
处理器
(x86程序集)上运行代码
assembly
、
x86
、
multiprocessing
、
smp
、
real-mode
在x86上的真实模式中,在多
处理器
系统中,在不同的
处理器
上运行代码需要
使用
哪些
指令
?(我正在汇编程序中编写一些
预
引导代码,这些代码需要设置特定的CPU寄存器,并在实际操作系统启动之前,在系统中的每个CPU上这样做。)
浏览 3
提问于2009-10-25
得票数 10
回答已采纳
1
回答
PLD
指令
的
使用
arm
、
cpu-cache
、
mmu
、
cortex-a8
由于我
使用
的
指令
内部循环,有可能超出绑定内存访问。我怀疑这是否会导致分割错误。我在上读到 因此,如果进行超出绑定的内存访问,相应的PLD
指令
将被忽略或不被忽略,我对此表示怀疑。
浏览 2
提问于2012-10-30
得票数 5
回答已采纳
7
回答
分支预测对性能的影响?
performance
、
optimization
当我编写一些需要快速工作的紧凑循环时,我经常被关于
处理器
分支预测将如何表现的想法所困扰。例如,我尽量避免在最内层的循环中
使用
if语句,特别是结果不太一致(随机计算为true或false )的语句。我倾向于这样做,因为有些常识是
处理器
预
取
指令
,如果结果是它错误地预测了一个分支,那么
预
取是无用的。哪些编码模式可以让它变得更好?
浏览 2
提问于2008-11-14
得票数 18
1
回答
按命名
成员
初始化结构
c
、
data-structures
、
struct
、
initialization
1].a[0] = 2理想情况下,我会找到一些方法来做以下事情:{} foo = .a = 4,}; 我想要按
名称
初始化结构的原因是我自己的结构有很多
成员
我不应该只在单独的语句中初始化它们,因为这是一个性能敏感的嵌入式应用程序,其中的
成员
实际上是位字段,因此单个struct init
生成
的
指令
比多个
成员
初始化
生成
的
指令
要少。哪个C标准允许像这样按
名称</e
浏览 0
提问于2011-07-15
得票数 0
回答已采纳
1
回答
用户堆栈的单
指令
推送/弹出,而不是附件函数调用?
c
、
stack
、
machine-instruction
在
处理器
堆栈上,push、mov和pop等都是单
指令
。在编译源代码时,编译器
生成
单机
指令
版本,但在运行时,假设堆栈是...一个普通的堆栈容器,在运行时访问存储在堆栈上的值需要进行函数调用,这会转化为大量的机器代码。可以实现动态运行时对象的相同效率,而不是
使用
比单个机器
指令
长得多的setter和getter
成员
函数?我的想法是
使用
标记指针,但我不知道如何在运行时将其值直接推送到内存位置或从内存位置推送,而不是求助于函数调用。 内联汇编可能是一种选择,如果
浏览 2
提问于2012-01-20
得票数 0
1
回答
L2
指令
提取丢失率远高于L1
指令
获取错误
performance
、
intel
、
cpu-architecture
、
cpu-cache
、
perf
我正在
生成
一个合成C基准,其目的是通过以下Python脚本导致大量的
指令
提取错误: L2_RQSTS.CODE_RD_MISS在我的(简单)心智
处理器
模型中,如果
浏览 1
提问于2017-01-28
得票数 7
3
回答
为ARM编译时出现GCC错误
c
、
gcc
、
linker
、
embedded
、
arm
我在尝试
使用
以下命令编译ARM Cortex-M4的一些代码时遇到以下错误 `-mcpu=' is deprecated.对于
使用
ARM的GCC来说,任何入门都会很有帮助。
浏览 1
提问于2012-11-01
得票数 3
1
回答
缓存
预
取是在硬件地址空间还是在虚拟地址空间完成?
performance
、
caching
、
memory
硬件
预
取器是对连续的虚拟地址进行操作,还是在连续的硬件地址上操作?想象一下,您有一个跨越多个页面的大字节数组。在虚拟地址空间中,字节是连续的,但实际上,在硬件中,页面可以在不相交的页面中分配。我希望
预
取程序能够在TLB开始引入属于下一页的缓存行之前
使用
TLB进行适当的转换。 是这样吗?我找不到证实这一点的信息,希望有人能给我更多的洞察力。
浏览 0
提问于2017-03-23
得票数 7
回答已采纳
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