试想与我们相伴的MCU如若只存在裸机程序，那么运行到一个包含延时的线程时，我们的CPU就开始“摸鱼”了。为了最大化运行CPU，就需要用到RTOS（Real Time Operating System). 简单来说，RTOS是一个调度一切可利用的资源完成实时任务，并控制所有实时任务协调一致运行的操作系统，或者说，其内核是一个任务管理的框架。
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Cortex-M处理器系列的最新成员是Cortex-M7。这款新的核心具备可用于支持新型嵌入式技术需求的功能，它设计用于需要较高处理性能、实时响应能力和能效的应用。总体而言，Cortex-M7处理器包含下列关键特性： • 高性能、双指令签发6级流水线，每个时钟周期最多可执行两个指令； • 64位AXI系统总线接口； • 可选指令缓存（4到64KB）及数据缓存（4到64KB），每种缓存内存均有可选的ECC（错误校正码）支持； • 可选64位指令紧密耦合内存（ITCM）及可选双32位数据TCM（D{0,1}TC
4. 寄存器位。通常是表示一个位段的数值，例如 bit[15:12] 表示位序号从15往下数到12，这一段的数值。
中断就是系统正在处理某一个正常事件，忽然被另一个需要马上处理的紧急事件打断，系统转而处理这个紧急事件，待处理完毕，再恢复运行刚才被打断的事件。 无论在单片机开发还是嵌入式开发中，中断都是一个非常重要的概念。而重要的原因，是中断的概念符合我们普世生活的场景。 你正在上班努力编程，却有一通电话打了进来，而不得不停止工作，接通完电话后，发现只是外卖到了楼下，这时候你又恢复到工作的状态，这是短期中断。 你本科毕业，因为第一年的工作经验的优先级高于考研所以你去找了份工作，干了一年后，去考研，回到学校继续学习，对你的学业来说，这也是中断，无非是中断处理时间长而已。 本文将会介绍嵌入式开发中，中断管理的概念，及基于RTOS的一些例子。
笔者接触嵌入式领域软件开发已近五年，几乎用的都是 ARM Cortex M 内核系列的微控制器。在这五年期间，感谢 C 语言编译器的存在，让我不用接触汇编即可进行开发，但是彷佛也错过了一些风景，没有领域到编译器之美和 CPU 之美，所以决定周末无聊的休息时间通过寻找资料、动手实验、得出结论的方法来探索 ARM CPU 架构的美妙，以及 C 语言编译器的奥秘。（因为我个人实在是不赞同学校中微机原理类课程的教学方法）。
参考资料：STM32F103数据手册.pdf、ARM Cortex-M3与Cortex-M4权威指南.pdf、PM0056.pdf
在中国，熟悉单片机的人士大多会听说过STM32。这是意法半导体（STMicroelectronics， 简称ST）的32位微控制器（MCU）家族，基于ARMCortex-M内核。
STM32的核心Cortex-M3处理器是一个标准化的微控制器结构，希望思考一下，何为标准化?简言之，Cortex-M3处理器拥有32位CPU，并行总线结构，嵌套中断向量控制单元，调试系统以及标准的存
开头部分描述了文件的用途及版权声明：基于GCC编译链的STM32F407xx设备中断向量表，主要描述了
ARM处理器是英国Acorn有限公司设计的低功耗成本的第一款RISC微处理器。全称为Advanced RISC Machine。
全球顶级嵌入式会展Embedded Word2020这个月底就开了，各路厂家都将拿出看家本领。
NVIC 的寄存器以存储器映射的方式来访问，除了包含控制寄存器和中断处理的控制逻辑之外， NVIC 还包含了 MPU、 SysTick 定时器以及调试控制相关的寄存器。
在阅读本文之前，有两个定义在FreeRTOSConfig.h中的宏，你必须先明白它们是什么意思，《FreeRTOS内核配置说明》一文中，讲解了这两个宏：
“基于 ARM Cortex-M3 处理器与 FPGA 的实时人脸检测 SOC”的概述请看《基于 ARM Cortex-M3 处理器与 FPGA 的实时人脸检测 SOC（查看公众号上篇内容）》，本篇文章是对“基于 ARM Cortex-M3 处理器与 FPGA 的实时人脸检测 SOC”中涉及到的技术细节的介绍，希望您能有所收获。
进互联网公司操作系统和网络库是基础技能，面试过不去的看，这里基于嵌入式操作系统分几章来总结一下任务调度、内存分配和网络协议栈的基础原理和代码实现。
1978年12月5日，物理学家赫尔曼·豪泽（Hermann Hauser）和工程师Chris Curry，在英国剑桥创办了CPU公司（Cambridge Processing Unit），主要业务是为当地市场供应电子设备。
Cortex-M3 内核发生中断时，硬件会自动将 XPSR、PC、LR、R12、R3、R2、R1 和 R0 这 8 个寄存器压入栈，其余的 R4~R11、LR、XPSR 寄存器的备份则需要由 C 编译器去做。
在PS内的时钟模块可以为PL提供4个时钟FCLKCLK[3:0]，这4个时钟的频率可以通过配置界面进行修改。由于这4个时钟的频率由PS引到PL中，所以可将FCLK连接到PL时钟缓冲区，作为PL内定制外设的时钟源。
单片机：Single-Chip Microcomputer,单片微型计算机，是一种集成电路芯片
1978年，奥地利籍物理学博士Hermann Hauser，和他朋友，一位英国工程师Chris Curry，共同创建了一 家名为“Cambridge Processor Unit，CPU”的公司，中文字面意思就是“剑桥处理器单元”，主要从事研发 当地电子仪器设备的业务，比如街头游戏机之类的。
我发现学习 RTOS 是学习 Linux 内核的好方法。大有弯道超车的可能。 1. 任务堆栈 1.1 任务栈大小确定 1.2 栈溢出检测机制 2. 任务状态 3. 任务优先级 3.1任务优先级说明 3.2 任务优先级分配方案 3.3 任务优先级与终端优先级的区别 4. 任务调度 4.1 调度器 5. 临界区、锁与系统时间 5.1 临界区与开关中断 5.2 锁 5.3 FreeRTOS 系统时钟节拍和时间管理 一、 单任务系统（裸机） 主要是采用超级循环系统（前后台系统），应用程序是一个无限的循环，循环中调用
其中，ARM7、ARM9、ARM9E和ARM10为4个通用处理器系列，每一个系列提供一套相对独特的性能来满足不同应用领域的需求。SecurCore系列专门为安全要求较高的应用而设计。
写在前面： 本文章旨在总结备份、方便以后查询，由于是个人总结，如有不对，欢迎指正；另外，内容大部分来自网络、书籍、和各类手册，如若侵权请告知，马上删帖致歉。
arm内核： arm内核主要由：寄存器 、指令集 、总线 、存储器映射规则 、中断逻辑 和调试组件 等。
论坛原始地址（持续更新）：http://www.armbbs.cn/forum.php?mod=viewthread&tid=99514 第15章 ThreadX系统时钟节拍和时间管理(绝
大家好，又见面了，我是你们的朋友全栈君。 朋友们，如果你需要在STM32上移植RTOS，那么首先必须深入理解它的中断系统。什么是NVIC?即嵌套向量中断控制器(Nested Vectored I
在这之前让我们先简单认识一下处理器的架构。所谓处理器架构是CPU厂商给属于同一系列的CPU产品定的一个规范，主要目的是为了区分不同类型CPU的重要标示。目前市面上的CPU指令集分类主要分有两大阵营，一个是intel、AMD为首的复杂指令集CPU，另一个是以IBM、ARM为首的精简指令集CPU。不同品牌的CPU，其产品的架构也不相同，例如，Intel、AMD的CPU是X86架构的，而IBM公司的CPU是PowerPC架构，ARM公司是ARM架构。 下面我们将详细了解近年来ARM公司发布的数款A系列处理器。ARM公司的Cortex-A系列处理器适用于具有高计算要求、运行丰富操作系统以及提供交互媒体和图形体验的应用领域。 Cortex-A73
本文从任务如何切换开始讲起，引出RTOS内核中的就绪列表、优先级表，一层一层为你揭开RTOS内核优先级抢占式调度方法的神秘面纱，只有对内核的深入了解，才能创造出更好的应用。
随着ARM处理器性能不断增强，当前越来越多产品都倾向尽量用单一架构的高性能ARM平台来满足产品的不同功能要求。但是，在工业应用领域还是要面对一些实时控制和通讯的要求，单一系统架构无法完全满足。面对复杂的工业应用场景，创龙科技推出了基于NXP i.MX 8M Mini设计的工业核心板和评估板，提供了四核Cortex-A53 + 单核Cortex-M4异构多核的组合使用方法，使Cortex-M4发挥出MCU实时控制性的特性，从而满足复杂的工业应用场景。
本章处理器架构的内容主要来自于ARM® Cortex™-A Series Programmer’s Guide version4.0。
一颗芯片最主要的就是CPU核了，处理CPU Core之外，还存在很多其他IP，包括Graphical、Multimedia、Memory Controller、USB Controller等等。
笔者接触嵌入式领域软件开发已近五年，几乎用的都是 ARM Cortex M 内核系列的微控制器。在这五年期间，感谢C语言编译器的存在，让我不用接触汇编即可进行开发，但是彷佛也错过了一些风景，没有领域到编译器之美和CPU之美，所以决定周末无聊的休息时间通过寻找资料、动手实验、得出结论的方法来探索 ARM CPU 架构的美妙，以及C语言编译器的奥秘。（因为我个人实在是不赞同学校中微机原理类课程的教学方法）。
（答案仅供参考，不喜勿喷~~） (本人比较懒，后面的就没仔细整) （注：如果你完成了我的“太懒啦”，我可以把你的加进去，附上你的名字，一起加油~~）
2010年，ARM推出了ARM DesignStart计划，开放了1000+IP的物理版图，2015年开源Cortex-M0 IP评估版本，2017年开源Cortex-M3 IP，2018年开源Cortex-A5 IP，提供了用户快速获取ARM IP的途径，通过提供的CPU和IP方案，用户可以更简单、更快速、更低风险的途径实现定制化SoC。
移动电话的普及使我们能够随时随地拨打电话。又经过20年的创新后，语音通话已不再是手机这款智能设备的主要功能，它不仅可以拍摄美丽的照片、播放音频和视频流文件，而且还提供各种各样的服务：现在还逐渐成为我们的私人教练。
F103 在内核水平上搭载了一个异常响应系统， 支持为数众多的系统异常和外部中断。其中系统异常有8 个(如果把Reset 和HardFault 也算上的话就是10 个)，外部中断有60个。除了个别异常的优先级被定死外，其它异常的优先级都是可编程的。有关具体的系统异常和外部中断可在标准库文件stm32f10x.h 这个头文件查询到，在IRQn_Type 这个结构体里面包含了F103 系列全部的异常声明。
http://mpvideo.qpic.cn/0b2e2iaamaaaemajnaohfbrfbuwda3jaabqa.f10002.mp4? 本课程主要目的在于以微控制器为蓝本，打好电子系统智能化领
1 高性能工业级核心板 创龙科技SOM-TLIMX8-B是一款基于NXP i.MX 8M Mini的四核ARM Cortex-A53 + 单核ARM Cortex-M4异构多核处理器设计的高端工业级核心板，ARM Cortex-A53(64-bit)主处理单元主频高达1.6GHz，ARM Cortex-M4实时处理单元主频高达400MHz。处理器采用14nm最新工艺，支持1080P60 H.264视频硬件编解码、1080P60 H.265视频硬件解码、GPU图形加速器。核心板通过工业级B2B连接器引出MIPI-CSI、MIPI-DSI、Audio、PCIe、FlexSPI、USB、UART、千兆网口等接口，可通过PCIe、FlexSPI、MIPI-CSI接口与FPGA进行高速通信。核心板经过专业的PCB Layout和高低温测试验证，稳定可靠，可满足各种工业应用环境。 用户使用核心板进行二次开发时，仅需专注上层运用，降低了开发难度和时间成本，可快速进行产品方案评估与技术预研。
Nuvoton’s NuMicro M2351 Cortex M23 MCU 指纹应用设计 1，ARM将ARMV8-A上的TrustZone技术移植到ARMv8-M上。 过去十年来，ARM与全球合作伙伴在全世界已经建立了一个32位系统嵌入式处理器巨大的生态，由于IoT的快速增长的需求，安全功能成为所有嵌入式系统的基础需求，ARM很自然的设计了下一代Cortex-M处理器! Cortex-M23和Cortex-M33处理器是非常受欢迎的Cortex-M产品系列最新成员。因此，这两个处理器保持了之前的预期特
从“2.2 ARM与STM32的关系”可知，ARM公司负责设计内核，半导体芯片厂商拿到内核授权后，根据产品需求，添加各类组件，生产芯片售卖。如图 6.1.1 所示，为STM32的组成示意图，其中Cortex-M3内核、调试系统都是ARM公司设计，内部总线、外设、存储、时钟复位等都由ST公司开发。
正常情况下，微处理器根据代码内容，按顺序执行指令。执行过程中，如果遇到其它紧急的事件需要处理，则先暂停当前任务，执行紧急事件，待紧急事件处理完后，再恢复到刚才暂停的地方继续执行。这个产生的紧急事件就叫做中断或异常，如图 10.1.1 所示。
FreeRTOS 的中断配置是一个很重要的内容，需要根据所使用的 MCU 来具体配置。这需要 了解 MCU 架构中有关中断的知识，本文结合 Cortex-M 的 NVIC 来讲解 STM32 平台下的 FreeRTOS 中断配置，分为如下几部分：
国外专业的拆解机构iFixit在2月3日率先发布了对Vision Pro的拆解报告之后，2月7日，iFixit发布了对Vision Pro更为深入芯片级的分析报告，显示其中有着大量的德州仪器（TI）芯片，还有兆易创新的NorFlash。
论坛原始地址（持续更新）：http://www.armbbs.cn/forum.php?mod=viewthread&tid=93149 第3章 RTX5操作系统介绍 本章节介绍一下RTX5操作系
NXP i.MX系列应用处理器是基于32和64位ARM技术，提供多核解决方案，适用于多媒体和显示应用，具有高性能和低功耗、可扩展、安全可靠等特点。其成员有i.MX28系列、i.MX 6系列、i.MX 7系列、i.MX 8系列、i.MX RT系列。这篇文章主要介绍i.MX 8系列。
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