易于gnu使makefile规则，以建立从多个源文件的GCC可执行文件

GNU Make是一个构建自动化工具，它可以根据一组规则自动构建和管理软件项目。Makefile是GNU Make使用的一种文件格式，其中包含了构建项目所需的规则和命令。

Makefile规则是指定义了如何生成目标文件的规范。每个规则由一个目标（target）、一个或多个依赖（dependencies）和一组命令（commands）组成。当目标文件不存在或其依赖发生变化时，Make会根据规则自动执行相应的命令来生成目标文件。

GCC是GNU Compiler Collection的缩写，是一个开源的编译器套件，支持多种编程语言，如C、C++、Objective-C等。通过使用GCC，可以将源代码编译成可执行文件。

在构建从多个源文件的GCC可执行文件时，可以使用Makefile来定义相应的规则。以下是一个示例的Makefile：

CC = gcc
CFLAGS = -Wall -O2

SRCS = main.c file1.c file2.c
OBJS = $(SRCS:.c=.o)
TARGET = myprogram

$(TARGET): $(OBJS)
    $(CC) $(CFLAGS) -o $@ $^

%.o: %.c
    $(CC) $(CFLAGS) -c $< -o $@

clean:
    rm -f $(OBJS) $(TARGET)

在上述示例中，SRCS变量定义了源文件列表，OBJS变量定义了对应的目标文件列表，TARGET变量定义了最终生成的可执行文件名。

规则$(TARGET): $(OBJS)指定了生成$(TARGET)目标文件所需的依赖为$(OBJS)，并定义了生成目标文件的命令$(CC) $(CFLAGS) -o $@ $^。

规则%.o: %.c指定了生成.o目标文件所需的依赖为对应的.c源文件，并定义了生成目标文件的命令$(CC) $(CFLAGS) -c $< -o $@。

通过运行make命令，Make会根据Makefile中的规则自动构建可执行文件myprogram。

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