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(693)
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沙龙
3
回答
ALU
中
溢出
标志
的计算
、
、
我目前正在用VHDL模拟Xilinx中的
ALU
。
ALU
有以下输入和输出: 我使用多路复用器和加
浏览 11
提问于2015-12-30
得票数 5
回答已采纳
1
回答
ALU
32位,
溢出
,
零
标志
、
、
该
ALU
可以根据提供给
ALU
的操作码对两个数据输入执行加、减、与、或运算。名为Operation的两位控制输入部分指定操作码。我一直在尝试工作,但总是得到错误,仍然想添加适当的
零
标志
和
溢出
,但每次尝试在线我从头开始。A and B wait;END; 我已经添加了
零
标志
,但modelsim无法读
浏览 25
提问于2020-10-05
得票数 0
2
回答
为什么没有为二进制减法设置
溢出
标志
?
、
、
、
例如:reg [31:0] b = 32'hFFFF_FFFF; 我知道c=a-b将导致
零
,并且
溢出
标志
将不会被设置我的理解是,
ALU
使用减数(运算符的右侧)的2的补码,并将其添加到被减数(运算符的左侧)。 因此,存储在reg b中的值的2补码是32'h1。现在,如果我把这个加到reg a上,我会得到32个0和1,这是
溢出
的。那么为什么没有设置
溢出
标
浏览 5
提问于2018-05-02
得票数 0
1
回答
带
溢出
、符号和
零
标志
的Verilog 32位
ALU
、
、
、
我需要添加、减去AND和XOR两个输入并设置必要的
标志
。赋值不是100%清楚的,但我假设overflow
标志
将使其他所有内容无效,所以我不需要担心超过32位结果的任何事情。我的问题来自于
零
和
溢出
标志
,无论我怎么尝试,这两个
标志
似乎永远不会被设置。我把我在网上找到的一些方法放在一起,但我不确定这些方法是错的还是我写错了。一切都会编译并运行,但无论我使用什么输入,我的
标志
都不会设置。我只上了一个Verilog类,没有记住很多限制,所以如果有任何帮助,我将不胜感激。modul
浏览 1
提问于2016-03-03
得票数 1
2
回答
32位
ALU
在VHDL中的实现
、
我应该用VHDL写一个简单的32位
Alu
。一切都很好,除了两件事。
ALU
应该有一个进位和
溢出
标志
,但我不知道如何实现它。对于Overflow
标志
:由于
ALU
的描述是行为的,所以我不能访问任何进位,这意味着我不能通
浏览 0
提问于2013-08-01
得票数 2
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2
回答
如何检测verilog中的
溢出
?
因此,我的目标是在添加两个64位变量A和B时检测
溢出
。= (
ALU
_Result-B))
ALU
_Result是我的成绩。我认为它所持有的值将是第一个64位,所以这个等式会给出
标志
,但这也不起作用。如何创建国旗?另外,如果存在
溢出
,那么进位是否自动为1?
浏览 13
提问于2022-03-04
得票数 0
2
回答
RISCV:如何计算分支结构?
、
、
、
、
根据我所读到的,
ALU
单元只有一个信号输出-- ZERO (除了它的数学输出),它在输出为
零
时是活动的。但是,如何才能根据ZERO输出确定是否应该使用分支呢?他们是怎么计算出来的?
浏览 2
提问于2019-08-11
得票数 6
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1
回答
使用Verilog在32位
ALU
中实现一位
标志
、
、
、
、
我需要在32位
ALU
中实现以下
标志
:·N(“负”):如果结果的第一个位数为1,则设置为1(“真”),表示负数如果输入a小于输入b,则为LT如果输入a等于输入b,则EQ 我需要修改这个
ALU
,以包含三个
标志
和比较输出我只是需要一些帮助来理解这些<em
浏览 3
提问于2015-12-06
得票数 1
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1
回答
理解
溢出
和携带
标志
之间的区别
、
、
、
、
我正在设计一个16位
ALU
在verilog基于现有的RISC ISA。ISA表示,在操作未签名时设置进位
标志
,在对操作进行签名时设置
溢出
。“
溢出
”与“携带”只是解释的问题,所以对两者都使用相同的功能。module
ALU
(); input wire [15:0]y; outputx = -1在这种情况下,答案是正确的2s恭维,不需要设
浏览 10
提问于2021-09-09
得票数 3
回答已采纳
2
回答
零
旗和带旗的区别是什么?
、
、
零
旗和带旗有什么区别?对于
零
标志
,上面写着inc ax ; AX= 0 , ZF=1 mov al , 0FFhAL的值等于
零
,那么为什么
零
标志
没有设置为1呢?
浏览 3
提问于2012-06-08
得票数 4
回答已采纳
2
回答
ALU
是如何工作的?
、
、
当求和结果为(1)00000000,1为进位输出时,是否应将
ALU
的
零
标志
设置为1?或者结果被认为不同于0?
浏览 0
提问于2012-03-07
得票数 1
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2
回答
VHDL if条件不能正常工作
我正在尝试创建一个具有3位操作码的
ALU
。 alias NEG_TSEL : STD_LO
浏览 2
提问于2013-02-04
得票数 1
1
回答
是否需要有符号比较中的
溢出
标志
?
如果我需要实现一个
溢出
标志
来处理带符号的比较,我会遇到麻烦。在我目前的实现中,我只检查结果的0和符号位,以确定比较的结果:If the signset and the result is not zero y > x我没有使用
溢出
标志
来确定比较
浏览 15
提问于2017-07-06
得票数 0
1
回答
如何确定C中是否发生了执行
、
、
、
我正在编写一个ARM11模拟器,现在我试图设置CPRS
标志
,它们是N(负结果)、Z(
零
)、C(执行)和V(
溢出
)。在算术运算(add、sub、rsb和cmp)中,C位将被设置为执行
ALU
的位31。 编辑:对于附加,C被设置为1,如果加法产生一个进位(在ow上没有签名),否则它被设置为0。
浏览 7
提问于2014-06-04
得票数 0
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3
回答
算术
溢出
与算术进位
、
我的一篇演讲幻灯片给出了一个算术
溢出
的例子,并在ARM芯片上带了一个条件分支
标志
的主题,引用如下:大概是为了这个例子,这个地址只能容纳为什么这是算术
溢出
?滑梯上走错路了吗?还是我的理解有缺陷? 谢谢你的回复
浏览 6
提问于2011-06-07
得票数 29
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3
回答
xor是
ALU
能做的最快的运算吗?
、
、
、
xor是算术逻辑单元对一个字节所能做的最快的操作吗?我的教授说,这是因为没有什么比检查两个东西是否相同更简单的了。如果操作数不同,则返回1,如果操作数相同,则返回0,这是理解xor的正确方式吗?
浏览 9
提问于2012-10-05
得票数 1
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1
回答
算术逻辑单元如何知道比较的逻辑?
、
、
、
、
正如教授所解释的那样,CPU有一个
ALU
(Arithmetic Logic unit),它执行加法和比较等算术。但他没有解释它是如何做到的。甚至也解释说,CPU将算术处理导向
ALU
,但不处理
ALU
是如何执行的。 我的问题是
ALU
做comparison怎么样?作为人类,我们知道5小于7,但
ALU
是如何知道这一点的,它是以某种方式硬编码的吗?
浏览 2
提问于2014-01-07
得票数 2
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2
回答
为什么不是反过来呢?TST操作器臂32位组件
、
、
下面是我们的代码:(我从另一个问题中复制了它,该问题提出了类似但不相同的问题)TST R0, #1addne ... //add if not even感谢您的阅读。我已经看过文档了,我还是不能理解。
浏览 24
提问于2021-04-15
得票数 0
1
回答
x86
ALU
中的进位/辅助
标志
函数
、
、
、
我正试图在Verilog中创建一个8086处理器,而且我对大多数体系结构有着比一般人更好的基本理解(一旦我越过这一点,我就能愉快地相处),但我似乎无法理解
ALU
中的进位
标志
和辅助
标志
是如何工作的。据我所知,CF是在加法或减法时触发的(在这种情况下,它被称为借入),这会导致结果大于
ALU
的位宽。 但是,我将如何编写Verilog代码以进行加减,从而允许我写入
标志
位,然后重新访问它以继续操作?而且,这更像是一个n00b问题,但是如果SI和DI寄存器只有16位宽,带进位操作的
ALU
如何能够支持
浏览 1
提问于2013-08-02
得票数 1
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2
回答
为什么我们需要一个
标志
来表示
零
结果?
、
、
、
在shift、add、等指令中,我们总是检查结果,如果结果为
零
,则在
标志
中表示这一点。在什么情况下我们使用这个
零
标志
?这个
零
标志
有什么用?
浏览 0
提问于2019-03-20
得票数 0
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