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Makefile:将变量传播到依赖目标

Makefile是一种用于自动化构建和管理软件项目的工具。它使用一个名为Makefile的文件来定义构建规则和依赖关系,以及执行构建任务所需的命令。

在Makefile中,可以定义变量来存储各种值,例如文件路径、编译选项、版本号等。这些变量可以在Makefile的不同部分使用,并且可以通过传播到依赖目标来在整个构建过程中传递和使用。

传播变量到依赖目标可以通过在目标规则中使用变量来实现。当目标被执行时,变量的值将被展开并传递给命令。这样可以确保在构建过程中使用相同的变量值,提高代码的可维护性和灵活性。

Makefile中的变量可以通过以下方式传播到依赖目标:

  1. 直接传递:在目标规则中使用变量,例如:target: $(variable) command这样,当目标target被执行时,变量variable的值将被传递给command命令。
  2. 间接传递:通过依赖关系传递变量。例如:target: dependency command dependency: $(variable)在这种情况下,当目标target被执行时,依赖目标dependency也会被执行。在执行dependency目标时,变量variable的值将被传递给command命令。

通过传播变量到依赖目标,可以实现更灵活和可配置的构建过程。例如,可以使用变量来指定不同的编译选项、文件路径或版本号,以适应不同的构建需求。

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(1)Makefile中内置变量 $@、$^、$<、$? 。 $@ 表示目标文件,$^ 表示所有的依赖文件,$< 表示第一个依赖文件,$? 表示比目标还要新的依赖文件列表。...其实可以让编译器自动推导源文件使用了哪些头文件,这样我们就可以源文件使用的头文件添加到目标obj文件的依赖项中,读者可参考网上的资料,自行给出实现。...改进地方有两点: (5.1)多个源文件目录写到一个变量,然后再利用Makefile的Shell函数所有源文件目录下源文件取出。参考如下代码: DIR_SRC=./src0 ....7.2VPATH的单一作用 VPATH是Makefile的特殊变量,只能用来指明Makefile寻找目标文件的依赖项所在的目录,不能帮助编译器寻找所需编译的文件。...7.6Makefile中三个内置变量:$@、$<和$^ $@,$<,$^代表的意义分别是: $@:目标文件; $<:第一个依赖文件; $^:所有的依赖文件。

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如果这些依赖自身也是目标,继续为这些依赖扫描Makefile 建立其依赖关系,然后编译它们。....o 的目标依赖目标会自动推导为.p ,并且其生成命令是 隐含规则使用的变量 在隐含规则中的命令中,基本上都是使用了一些预先设置的变量。...这些奇怪的变量我们叫“自动化变量”,后面会详细讲述。 自动化变量 在上述的模式规则中,目标依赖文件都是一系列的文件,那么我们如何书写一个命令来完成从不同的依赖文件生成相应的目标?...如果依赖目标是以模式(即%)定义的,那么^ : 所有的依赖目标的集合。以空格分隔。如果在依赖目标中有多个重复的,那个这个变量会去除重复的依赖目标,只保留一份。...•+ : 这个变量很像^ ,也是所有依赖目标的集合。只是它不去除重复的依赖目标。 •* : 这个变量表示目标模式中% 及其之前的部分。

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Makefile基础语法

Makefile 是描述文件依赖关系的说明,由若干个规则组成,每个 规则 的格式如下: 目标依赖关系 命令 其中: 目标 是指 make 最终要创造的产物,也是 make 执行的动作名称...,例如 clean ; 依赖关系 是指编译目标体需要依赖的一个或多个文件列表; 命令 是指为了从依赖文件创造目标文件所需执行的命令。...make 执行的动作也是一个目标,为避免该目标和文件目标冲突,可以使用以下格式动作指定伪目标: .PHONY: clean clean: rm *.o temp 在使用时,在具有 Makefile...预定义变量 为使命令编写更快捷,免去无意义的重复操作,有一些预定义变量可以用于简化 Makefile 。...$@ # 规则目标对应的文件名 $* # 不包含扩展名的目标文件名称 $+ # 所有的依赖文件,用空格分开,可能包含重复 $% # 如果目标是归档成员,则该变量标识目标的归档成员名称

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Makefile 使用总结

$^     所有的依赖目标的集合。以空格分隔。如果在依赖目标中有多个重复的,那个这个变量会去除重复的依赖目标,只保留一份。 $+     这个变量很像"$^",也是所有依赖目标的集合。...只是它不去除重复的依赖目标。 $*     这个变量表示目标模式中"%"及其之前的部分。...中可以引用其他Makefile) 读入被include的其他Makefile 初始化文件中的变量 推导隐晦规则, 并分析所有规则 为所有的目标文件创建依赖关系链 根据依赖关系, 决定哪些目标要重新生成...Makefile 中很多时候通过自动变量来简化书写, 各个自动变量的含义如下: 自动变量 含义 $@ 目标集合 $% 当目标是函数库文件时, 表示其中的目标文件名 $< 第一个依赖目标....比目标新的依赖目标的集合 $^ 所有依赖目标的集合, 会去除重复的依赖目标 $+ 所有依赖目标的集合, 不会去除重复的依赖目标 $* 这个是GNU make特有的, 其它的make不一定支持 3.

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Linux学习笔记(二)、常用指令(下)

2、 汇编 汇编就是.c文件转换为汇编文件。 3、 编译 .c文件转换成的汇编文件转换成.o(object)的目标文件。...3)、如果目标文件不存在或者目标依赖的文件比目标文件新的话就会执行后面的命令来更新目标。...自动化变量模式中所定义的一系列的文件自动的逐个取出,直到所有的符合模式的文件都取完,自动化变量只应该出现在规则的命令中。 ? ? 最终makefile变为: ?...7、Makefile目标 回想之前的Makefile规则格式: 目标依赖文件。...在Makefile文件中,clean声明为伪目标,就是在clean的上一行添加声明: .PHONY:clean 8、Makefile条件判断 Makefile也支持条件判断,条件关键字为

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makefile从入门到放弃——博主吐血整理的笔记

makefile基本结构 makefile是make读入的唯一配置文件 由make工具创建的目标体(target),通常是目标文件或可执行文件 要创建的目标体所依赖的文件(dependency_file...其与C/C++所不同的是,你可以在Makefile中改变其值。在makefile中,变量可以使用在“目标”,“依赖目标”, “命令”或是Makefile的其它部分中。...: 变量变量含义 – $* 不包含扩展名的目标文件名称 – $+ 所有的依赖文件,以空格分开,并以出现后的先后为序,可能包含重复依赖文件 – $< 第一个依赖文件的名称 – $?...所有时间戳比目标文件晚的依赖文件,并以空格分开目标文件的完整名称 – $@ 目标文件的完整名称 – $^ 所有不重复的目标依赖文件,以空格分开 – $% 如果目标是归档成员,则该变量表示目标的归档成员的目标名称...makefile文件中的特殊变量VPATH就是完成这么一个功能,如果没有指明这个变量,make只会在当前目录中去寻找依赖文件和目标文件。

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实战Makefile前,该知道那些知识?

清空目标文件的规则(make clean命令): 每个Makefile中都应该写一个清空目标文件( .o 和目标文件等)的规则,这不仅便于重编译,也很 利于保持文件的清洁。...命令参数 -s 或 --silent 或 --quiet 则是全面禁止命令的显示 命令执行规则: 当依赖目标新于目标时,make会一条一条的执行其后的命令。...变量的定义:一般采用大写字母,赋值方式像C语言的赋值方式一样。 DIR = ./src/ 变量取值:使用括号变量括起来再加美元符。...说明,赋值符“=”,可以借助另外一个变量,可以变量的真实值推到后面去定义。也就是变量的真实值取决于它所引用的变量的最后一次有效值。...这些变量可以让我们更加快速的完成Makefile的编写,其中自动变量只能在规则中的命令使用,常用的自动变量如下: $@:规则中的目标 $<:规则中的第一个依赖文件 $^:规则中的所有依赖文件 CC

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makefile终极奥义

示例代码编译生成目标文件app....如果 edit 所依赖的 .o 文件也不存在,那么make会在当前文件中找目标为 .o 文件的依赖性,如果找到则再根据那一个规则生成 .o 文件。...这就是整个make的依赖性,make会一层又一层地去找文件的依赖关系,直到最终编译出第一个目标文件。...会自动推导生成.o文件 除了通配符,makefile还提供了自动推导的自动变量 自动变量 符号 含义 $@ 代表目标文件 $^ 代表所有依赖文件 $< 代表第一个依赖文件 由此第二个版本出来了 第二个版本...显式规则说明了如何生成一个或多个目标文件。这是由Makefile的书写者明显指出要生成的文件、文件的依赖文件和生成的命令。 隐晦规则。

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Makefile 的使用

,其样式如下: 目标(target)…: 依赖(prerequiries)… 命令(command) 如果“依赖文件”比“目标文件”更加新,那么执行“命令”来重新生成“目标文件”。...命令被执行的 2 个条件:依赖文件比目标文件新,或是 目标文件还没生成。 ③ 先介绍 Makefile 的 2 个函数 A....3.2 Makefile 规则 一个简单的 Makefile 文件包含一系列的“规则”,其样式如下: 目标(target)…: 依赖(prerequiries)… 命令(command) 目标...依赖是用来产生目标的材料(比如源文件),一个目标经常有几个依赖。 命令是生成目标时执行的动作,一个规则可以含有几个命令,每个命令占一行。...通常,如果一个依赖发生了变化,就需要规则调用命令以更新或创建目标。但是并非所有的目标都有依赖,例如,目标“clean”的作用是清除文件,它没有依赖。 规则一般是用于解释怎样和何时重建目标

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Make

###二、Make的一般使用: 1、Makefile的基本构成: Makefile由规则构成,一条规则生成一个或多个目标文件,其格式如下: 目标文件列表 分隔符 依赖文件列表 [;命令] //[]中的内容可选...2、Makefile文件的构成: 一个完整的makefile文件由5个部分构成:显式规则、隐含规则、变量、文件指示和注释。 显式规则:一条显式规则指名了目标文件、目标文件的依赖关系、命令。...文件指示:包括三个部分,一个类似于c语言中的include语句,可以另一个makefile文件包含进来;二是根据情况指定makefile中的有效部分,就像c语言中的预编译#if一样;三是定义一个多行的命令...$<:规则中的第一个依赖文件名。 $>:当规则是一个静态库文件时,该变量表示静态库名。 $?:所有比目标文件新的依赖文件列表,以空格分隔。...如果目标是静态库文件,该变量代表的是 库成员。 $^:规则的所有依赖文件列表,以空格分割。如果目标是静态库文件,代表的是库成员。

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