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我正在尝试编写一个makefile，以便有选择地包含某个文件。 我已经设法让它通过以下方式工作： OBJS := $(filter-out ./build/./src/class_2.cpp.o $(OBJS) 但我想让它更通用，并使用通配符。 我的理解是，以下几点应该是可行的： OBJS := $(filter-out $(wildcard ./src/*), $(OBJS)) 但不确定是特殊符号的问题，还是只是一个基本的理解。 然而，它会抱怨有太多的main函数(class 1
浏览 21提问于2019-04-09得票数 0
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因此，我在理解%通配符实际如何使用makefile时遇到了一些问题。我看过GNU make man中的静态模式规则，但是我仍然很困惑，我觉得我看到他们做了一些类似于我下面的事情。
浏览 4提问于2014-08-30得票数 2
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我正在尝试使用Makefile使用以下命令以符号方式链接多个文件：ln -s $(PWD)/bin/* ../../../bin/destination任何帮助都将不胜感激。
浏览 0提问于2015-03-31得票数 0
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Makefile.o -o MakefileMakefile:1: warning: NUL character seen; rest of line ignoredMakefile:1: *** missing separator.这是makefile：DEBUG ?此外，$(BIN)如何才能成为Makefile？编辑
浏览 6提问于2016-01-23得票数 1
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我有一条规则 gcc <certain compiler switches>我想我只是简单地在第一条规则之前加上foobar.o : foobar.cfoo和foobar的显式规则是否覆盖*.o：*.c规则？
浏览 1提问于2013-02-22得票数 0
我正在使用Makefile在Linux上编译一个应用程序。我的编译器来自Imperas (ovp world)。我的Makefile看起来像这样：
//////////////////////////////////
浏览 2提问于2017-05-18得票数 0
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目录结构(要运行此示例)如下所示： |-- Makefile | |-- foo.h (empty file) | |-- bar.h(empty file)TARGETS=foo bar
$(1)_INCS = $(wildcard $(1)/*.h)bar.h]
预期产出如下：$(bar_INCS) is [bar
浏览 0提问于2018-06-07得票数 0
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我认为Makefile中的百分比意味着通配符。作为尝试，我测试了一个旨在将任何.c文件更改为“hi”的设计Makefile。这是我的Makefile规则： mv $@ hitouch hello.c终点站说
( b)我们如
浏览 0提问于2015-04-15得票数 2
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我正在尝试创建一个带有通配符目标的makefile，但是通配符应该与变量匹配。所以我有一个这样的makefile：B_OUT := bin/b
$(%_OUT):输出：
$ make
浏览 5提问于2016-03-06得票数 0
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我正在为一个部分java的项目写一个makefile。我正在将其移植到Windows上，因此我正在调整一个使用mingw调用的makefile。不管怎样，我遇到的问题是我想调用在运行makefile时，我得到javac: file not found: *.java
但是如果我直接在命令提示符中调用它，我会得到预期的通配符行为。
浏览 1提问于2013-12-07得票数 0
我在顶部makefile中找到了以下行：为什么在这种特殊情况下会出现双美元签名？“$(通配符)”的作用是什么？为什么他们会被比较？(这个问题更多地是关于makefile结构的)马丁
浏览 0提问于2014-01-13得票数 2
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我已经直接下载了他们的makefile文件，但在我的Mac (Mojave)上遇到了问题。基本的结论是，目标定义中的'%‘通配符似乎不起作用。
浏览 0提问于2018-11-15得票数 1
这是我的问题:对于赋值，我应该有一个编译程序的Makefile。很简单。然而，它不起作用。这是Makefile： $(wildcard parsing/*.c) \-g -lX11 -lXext -std=gnu99 mlx/libmlx.a mlx/libmlx_Linux.a -lm
它工作正常，没有问题。在我看来，在通过Makefile执行与手动
浏览 4提问于2020-11-18得票数 0
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我知道我可以从makefile中的目标中使用自动变量$@来检索当前目标的名称。现在我想知道是否可能有这样的makefile：. g++ $@ && .我发现通配符可能与我的问题密切相关。但是，像这样的makefile： g++ $@ && ./a.out
确实创建了适当的目标，但是使用这样的makefile运行make test.cpp会生成make: >>test.cpp<< is
浏览 3提问于2014-02-05得票数 6
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我有一个Makefile：compiled_json := $(source:.p4=.json)
DEFAULT_PROGPCAP_DIR) $(LOG_DIR)
rm -f *.pcap我的问题是
浏览 1提问于2022-02-03得票数 0
我使用Makefile中的通配符来选择所有以.c后缀结尾的文件。看起来就像那个SRCS := $(wildcard *.c)。在Makefile的其他部分中使用SRCS。-name "*.c" | grep -v "file_to_exclude.c" | xargs)
这样做很好，但我想知道是否还有其他更优雅的方法，而不是只使用通配符的方法。
浏览 0提问于2012-07-02得票数 1
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据我所知，Makefile中的$wildcard函数用于扩展*或？例如,扩展到扩展名为.c的所有文件。但是在linux Makefile中，我看到很多通配符函数没有使用*或？例如为什么我们不能这样做
ARCH_POSTLINK:= $(srctree)/arch/$(SRCARCH)&#x
浏览 19提问于2020-11-15得票数 0
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我对Makefile和内核模块非常熟悉，但最近我在Makefile中遇到了一个问题--使用通配符没有任何意义。为了演示这一点，我正在从头编译hello world内核模块。目录结构如下： | |下面是实际的makefile：
浏览 2提问于2013-08-04得票数 1
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根据我所能找到的，Makefile目标中的通配符:先决条件行是一个模式规则，它声明“对于每个目标X.o，如果存在一个名为X.c的文件(例如)，执行以下命令”当我全部运行时，我得到了这个输出：second %.o : %.c
据我所知，应该显示这两个通配符语句
浏览 0提问于2015-11-30得票数 1
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因此，GNU Make的$(通配符)函数在Windows上保持目录打开似乎存在这个问题。参见(unasnwered)发布"“。谷歌没有提供太多关于这个话题的信息。简而言之: Makefile在某些时候使用$(通配符)函数，并保持目录打开，这通常会阻止"make clean“规则正确执行其工作。再次运行"make clean“通常可以解决这个问题。有人找到解决这个问题的办法了吗？
浏览 4提问于2008-10-15得票数 2
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