下周就要计算机组成原理考试了 不过我现在才刚刚开始准备动手准备 不知道会不会凉凉呢 赶紧学吧
在之前的文章中[2]，我们聊到了计算机的冯·诺依曼计算机架构，计算机由五大部件组成。那么，计算机的五大部件是如何连接成一个整体的呢？这就需要依赖总线系统。
图中由上至下，位价越来越低，速度越来越慢，容量越来越大。 磁盘、磁带属于辅助存储器。
CAS 是 compare and swap 的缩写，即我们所说的比较与交换。CAS 操作包含三个操作数，分别是内存位置（V）、预期原值（A）和新值(B)。当且仅当内存位置的V值和预期原值A相等的时候，那么就将内存里面的值V更新成新值B。其实现方式是通过C++调用CPU指令完成的，所以效率较高。基于乐观锁操作，通过某种方式不加锁来处理资源，比如通过给记录加上version来获取数据，性能较悲观锁有很大提高。
计算机的存储机构包括了 CPU 的 寄存器，用于临时缓存指令数据，还有 高速缓存 Cache、内存 和 外存，如下图所示。
CAS 可以简单描述比较并交换，Java中轻量级锁的理论支持。CAS很早就出现了，并且以此为理论基础实现了很多有趣的工具，Java依赖的就是操作系统中的cmpxchg指令。 ps：这里的CAS是compare and swap
事件总线通过数据传递订阅查找反射，可以将代码预编转。再通过转化的方式将事件终端的数据传输到接收方事件。vue事件总线的原理就是如此，主要还是通过Windows系统以及android系统对数据进行加工分类。
我们都知道在vue组件中有很多通信方式，例如我们都熟知和常见的父子组件通信和兄弟组件通信。在其中还有一种功能非常强大的通信方式，可以做到跨组件通信，那就是事件总线。事件总线的原理是什么呢？下文将会有一个详细的介绍，请阅读下文。
在408中，其中数据结构和组成原理各占45分,操作系统占35分,计算机网络占25分。计算机组成原理的知识点非常的多，且杂。很多人朋友都喜欢直接背组成原理的知识点。但是冷月认为，背很有局限性。只有融合贯通了，才能以不变应万变。
在《图解 | CPU-Cache》一文中介绍了VIVT、PIPT、VIPT三种Cache查找方式。
我们根据can总线具有的一些特性可知：CAN总线肯定具有分层结构，而且参考OSI模型（OSI参考模型介绍）是肯定的，我们可以看一下相关的文档可知：CAN遵从OSI模型。
Java代码在编译后会变成Java字节码，字节码被类加载器加载到JVM里，JVM执行字节码，最终需要转化为汇编指令在CPU上执行，Java中所使用的并发机制依赖于JVM的实现和CPU的指令。
处理器会自动保证基本的内存操作的原子性。处理器保证从系统内存中读取或者写入一个字节是原子的，即：当一个处理器读取一个字节时，其他处理器不能访问这个字节的内存地址。
① 全称 : Carrier Sense Multiple Access With Collision Avoidance , 载波监听多点接入 / 碰撞避免 协议 ;
Spring Cloud Bus 配合Spring Cloud Config 使用可以实现配置的动态刷新。
因为后续内存管理的内容会涉及一些数据结构，这些数据结构使用到了指针，同时存储指针的值是需要内存空间的，所以我们需要了解指针的大小，便于我们理解一些设计的意图；其次，这也是困扰我的一个问题，因为有看见64位平台下指针底层定义的类型为uint64。
http://www.blogjava.net/xylz/archive/2010/07/04/325206.html
https://download.csdn.net/download/weixin_42104154/14922915
CAN总线在硬件系统中占有一席之地，国际上应用最广泛的现场总线之一，与我们讲过的SPI、UART不同，属于“高端高效”系列。
计算机体系结构分类— Flynn CISC与RISC 层细化存储结构 Cache - 概念 Cache的功能：提高CPU数据输入输出的速率，突破冯.诺依曼瓶颈，即CPU与存 储系统间数据传送带宽限制。
总线风暴，听着真是一个帅气的词语，但如果发生在你的系统上那就不是很美丽了，废话不多说，先看图说结论。
记得在HINOC1.0的时候，FPGA样机上采用Intel XScale PXA270（ARM CPU）芯片与FPGA芯片互连，采用的接口时序就是Local Bus总线的时序，该时序与CPU与外挂异步SRAM接口时序一样，这样HINOC芯片就可以看做是ARM CPU的一个外设，可以分配可配置的寄存器或RAM等访问空间。具体时序图如下图所示，总线包括地址、片选、读/写信号，下图是简单的读时序。注意，所谓异步，就是CPU接口总线与FPGA相应接口是不同步的，也就是CPU送给FPGA的信号中不包括时钟信号，FPGA需要通过自己内部的时钟信号去采CPU接口的地址、数据等信号，同步后才能使用。如下图中的CPU读FPGA时序，CPU给出度地址和读控制信号后，等待tAA时间后才能从数据总线上取到正确的有效的数据，这个tAA时间长短是可以通过设置PXA270中的寄存器来进行调整的。
PCF8591 是单片、单电源低功耗8位CMOS数据采集器件，具有4个模拟输入（其中一个为电压模拟输入）、一个模拟输出和一个串行I2C总线接口。3个地址引脚A0、A1和A2用于编程硬件地址，允许将最多8个器件连接至I2C总线而不需要额外硬件。器件的地址、控制和数据通过两线双向I2C总线传输。器件功能包括多路复用模拟输入、片上跟踪和保持功能、8位模数转换和8位数模拟转换。最大转换速率取决于I2C 总线的最高速率。
b. 将编好的程序和原始数据事先存入存储器中，然后再启动计算机工作，使计算机在不需要人工干预的情况下，自动、高速地从存储器中取出指令加以执行，程序存储原理
冯·诺依曼架构（Von Neumann Architecture）是现代计算机体系结构的基石。这种架构由数学家和物理学家约翰·冯·诺依曼在1945年提出，奠定了当前计算机设计和运作的基本框架。本文将详细讲解冯·诺依曼架构的基本概念、核心组件、工作原理，以及其在计算机科学中的重要性。
总线（Bus）是计算机各种功能部件之间传送信息的公共通信干线，它是由导线组成的传输线束， 按照计算机所传输的信息种类，计算机的总线可以划分为数据总线、地址总线和控制总线，分别用来传输数据、数据地址和控制信号。总线是一种内部结构，它是cpu、内存、输入、输出设备传递信息的公用通道，主机的各个部件通过总线相连接，外部设备通过相应的接口电路再与总线相连接，从而形成了计算机硬件系统。在计算机系统中，各个部件之间传送信息的公共通路叫总线，微型计算机是以总线结构来连接各个功能部件的。 -- 百度百科
高端制造，在当前历史背景下独立自主是必经之路。先进技术是买不来的，高端制造是国之重器。
原子操作在并发编程中是很重要的概念之一，java中的并发的原子操作和各种锁的实现都少不了CAS的影子，本文从AtomicReferenceFieldUpdater类的使用开始说起，由浅入深，层层深挖，最终挖到硬件来描述并发领域中的最重要的概念：原子操作。 目录： 1、AtomicReferenceFieldUpdater的使用。 2、AtomicReferenceFieldUpdater源码分析。 3、CAS基本介绍。 4、CAS 底层原理。 5、CPU锁的种类。 5、CAS的缺点 使用 AtomicR
SAE J1939（以下简称J1939）是美国汽车工程协会（SAE）的推荐标准，用于为中重型道路车辆上电子部件间的通讯提供标准的体系结构。它由“卡车与大型客车电气与电子委员会”（Track & Bus Electrical & Electronics Committee）下属的“卡车与大型客车控制和通讯网络附属委员会”（Track & Bus Control and Communications Network Subcommittee）开发编写。
原子操作类，例如AtomicInteger，AtomicBoolean … 适用于并发量较小，多cpu情况下； Java中有许多线程安全类，比如线程安全的集合类。从Java5开始，在java.util.concurrent包下提供了大量支持高效并发访问的集合接口和实现类。如：ConcurrentMap、ConcurrentLinkedQueue等线程安全集合。 引入问题 那么问题来了，这些线程安全类的底层是怎么保证线程安全的，你可能会想到是不是使用同步代码锁synchronized？ 引入概念 这些线程安全类底层实现使用一种称为CAS的算法，(Compare And Swap)比较交换。其实现方式是基于硬件平台的汇编指令，在intel的CPU中，使用的是cmpxchg指令，也就是说CAS是靠硬件实现的，从而在硬件层面提升效率。 乐观锁，总是认为是线程安全的，不怕别的线程修改变量，如果修改了我就再重新尝试。 悲观锁：总是认为线程不安全，不管什么情况都进行加锁，要是获取锁失败，就阻塞。
今天我们讲一下java内存模型（JMM）,JMM的问题在面试中经常被问到，我们今天就讲一下这道题.
闲来无事，将复习时整理的部分资料push来，纯手打，部分错误根据自身基础忽略即可，不影响阅读。
Java语言中经常靠synchronized关键字保证同步的，这会导致有锁（也是我们经常所得重量级锁，因为其太过于繁重，所以才出现轻量级锁）。
目录 基础知识 总线 地址总线 数据总线 控制总线 内存地址空间 总结 ---- 今天我们就开始学习有关汇编的相关知识了，感觉和之前学的STM32相类似，所以学习起来并没有感觉很困难，相反，感觉有点好玩，并且理解了底层原理，为等下学习计算机组成原理打下基础，然后笔记主要用来记录不清楚的知识点，怕自己等过会就忘记了。参考书籍是王爽老师的书。 基础知识 总线 总线，在物理意义上的概念就是一根根导线的集合；而在逻辑意义上，我们把它划分为地址总线，数据总线和控制总线 ，以一个
今天给大侠带来基于FPGA的实时图像边缘检测系统设计，由于篇幅较长，分三篇。今天带来第一篇，上篇，话不多说，上货。
(2) 设计实现能设基于微程序控制器的单总线CPU，使得MIPS程序能在单总线结构上运行，最终能运行简单的排序程序sort-5.hex。
2440启动过程算是一个难点，不太容易理解，而对于2440启动过程的理解，影响了后面裸机代码执行流程的分析，从而看出2440启动过程的重要性。
可编程USB转 UART/I2C /SMBusS/SPI/CAN/1 -Wire适配器USB2S USB 转 UART 应用
2、计数器查询；(优先级设置比较灵活，对故障不敏感，连线及控制部分过程比较复杂。)
vue作为有多种组件通信方式，例如我们都熟知的兄弟组件通信和父子组件通信。在两个页面有引入或者被引入关系的时候可以使用上述的两种通信组件。但是如果没有这些关系，vue事件总线怎么做呢？下文将会有一个介绍。
Redis Cluster 集群相关配置，使用集群方式的你必须重视和知晓。别嘴上原理说的头头是道，而集群有哪些配置？如何配置让集群快到飞起，实现真正的高可用却一头雾水，通过下面这些配置详解也让你对集群原理更加深刻，告别技术悬浮。
在上一篇文章里，我们聊到了 CPU 的三级缓存结构，提到 CPU 缓存就一定会聊到 CPU 的缓存一致性问题。那么，什么是缓存一致性问题，CPU Cache 的读取和写入过程是如何执行的，MESI 缓存一致性协议又是什么？今天我们将围绕这些问题展开。
个人理解：最主要的区别在于程序空间和数据空间是否是一体的，冯·诺依曼结构数据空间和地址空间是不分开的，而哈佛结构数据空间和地址空间是分开的 哈弗结构的优势：如果采用流水线设计，如三级流水线：取指，译指，执指，当取指使用程序空间，执指使用数据空间时，可以同时处理，但是传统冯诺依曼结构不支持。
北桥：CPU和内存、显卡等部件进行数据交换的唯一桥梁，即CPU想和其他任何部分通信，须经过北桥。北桥芯片中通常集成的还有内存控制器等，控制与内存的通信。现在的主板上已经看不到北桥，它的功能已被集成到CPU当中。
现场总线是应用在生产现场、在微机化测量控制设备之间实现双向串行多节点数字通信的系统，也被称为开放式、数字化、多点通信的底层控制网络。现场总线技术形成了真正分散在现场的完整控制系统，提高了控制系统运行的可靠性，丰富了控制设备的信息内容。为控制信息进入公用数据网络创造了条件，沟通了现场控制设备之间及其与更高控制管理层网络之间的联系,便于实现管控一体化，同时控制网络与数据网络的结合，便于实现信号的远程传送与异地远程自动控制。
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