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回答
如何检查
FPGA
设备是否连接到
服务器
?
linux
、
opencl
、
fpga
、
intel-fpga
出于某种原因,我只能远程控制包含
FPGA
的
服务器
(Intel Arria 10 GX
FPGA
)。但是当我使用Intel OpenCL中的命令来查找驱动程序时,我无法找到可以使用的
FPGA
设备。命令如下:aocl diagnose输出结果: 后来,我使用hardinfo检查
FPGA
是否包括在内,但不幸的是,没有有用的信息。唯一与
FPGA
相关的是,我在我的
服务器
下找到了两个关于
fpga
的文件(Ubuntu16.04)。由于我是第一次使用
FPGA<
浏览 14
提问于2021-12-07
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1
回答
建立TCP连接前所需的最小握手量
tcp
我有一台Windows PC,它在端口9000上运行TCP
服务器
。我也有一个
FPGA
,它是直接连接到PC通过一个10G端口。
FPGA
可以发送以太网帧来建立和维护与
服务器
的TCP连接,就是这样。也就是说,
FPGA
可以发送初始SYN,响应SYN-ACK等。 但是,我怀疑
服务器
需要握手才能确认初始的
FPGA
SYN。在
FPGA
能够与TCP
服务器
建立TCP连接之前,所需的最小握手量是多少?
浏览 0
提问于2013-05-16
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1
回答
错误:可移植性:3-Xilinx应用程序内存不足
fpga
、
xilinx
、
labview
我正在使用NI Labview
FPGA
在
FPGA
上编译和综合一个设计,并遇到了以下错误:- Estimate Resources - PlanAhead: 03:04 这是否意味着云编译
服务器
内存不足
浏览 0
提问于2017-01-17
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2
回答
使用
FPGA
和GPU加速PHP
php
、
gpu
、
fpga
我们有一些废弃的
FPGA
模块(Xilinx),还有我们自己的PHP
服务器
。
服务器
有时负载很高,特别是PHP脚本会加载
服务器
。我们想在GPU和
FPGA
上尝试PHP脚本执行的某些部分。 你认为如何?
浏览 2
提问于2013-08-01
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1
回答
接收UDP数据包
sockets
、
udp
、
wireshark
我目前正在研究
FPGA
和Ubuntu 20主机pc之间的UDP连接(防火墙关闭,不同的NIC测试)。为了发送UDP数据包,在
FPGA
上实现了一个自定义以太网程序。在接收端,有一个简单的UDP
服务器
接收这些数据包. 问题是,我不能接收任何数据包。简单的UDP
服务器
进行了测试,当我从另一台pc向它发送消息时,它可以工作。为了对
FPGA
进行故障排除,使用Wireshark对通信量进行监控。在Wireshark中,可以看到每个数据包及其数据,这意味着层1-4不负责()。工作和"
FPGA
浏览 1
提问于2022-03-31
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1
回答
FPGA
与PC以太网连接
linux
、
tcp
、
udp
、
fpga
、
ethernet
我想把
fpga
板的以太网直接连接到PC的以太网上,并在两个方向上进行数据传输。我对如何设置这个感到困惑。 与其直接连接,不如将
FPGA
板和PC板放在同一个局域网上。同样,我可以使用原始帧,还是应该使用TCP/IP或UDP?如果我选择TCP/I
浏览 2
提问于2017-12-29
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1
回答
labview中
FPGA
的编译
compilation
、
fpga
、
xilinx
、
labview
、
xilinx-ise
我对
FPGA
编译有问题。我用的是单板里约9602。我安装了: ,,LabVIEW
FPGA
:编译工作者无法执行编译。编译工作人员可能为此编译配置错误,或者可能处于错误状态。“ 让我困惑的是,我看到了:“在本地编译
服务器</
浏览 2
提问于2017-03-19
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1
回答
如何为在启用安全引导时与apt升级一起工作的树外模块创建Debian包
linux
、
debian
、
code-signing
、
kernel-module
、
apt
我们已经为一个带有Ubuntu18.04HWE内核的目标创建了我们自己的
fpga
驱动程序,使用安全引导支持的运行。这个驱动程序被签名并放入一个Debian包中,比如
fpga
- driver -5.3.0-42-Generic1.1_amd64.deb,然后我们将这个驱动程序上传到我们的自定义Ubuntu包
服务器
。在我们的目标上,我们在/etc/apt/ server e.list.d/文件夹中有一个指向包
服务器
的链接,我们可以用 sudo apt install
fpga</
浏览 4
提问于2020-05-06
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2
回答
FPGA
与web的连接
fpga
我知道有些
FPGA
板可能有以太网端口。但是,如何将
FPGA
板连接到互联网以接收和解码TCP/UDP数据包?基本上,我希望通过TCP或UDP从
服务器
接收一些数据,并在电路板上进行处理。
浏览 0
提问于2011-04-05
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1
回答
Bash循环并行化和迭代
bash
、
loops
、
parallel-processing
、
iteration
目标如下:我总共有40个
FPGA
。10个
FPGA
连接到一个程序员,也就是说,我有4个程序员来闪存所有40个
FPGA
。
FPGA
只能在每个程序员上连续编程。 programm
浏览 0
提问于2019-02-14
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1
回答
将Make配置为立即对坏目标失败
makefile
我的档案看上去像这样 cd fpgas/$(@)/build && $(MAKE) cd fpgas/$(@)/build && $(MAKE) cd fpgas/$(
浏览 4
提问于2017-11-17
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1
回答
Gnu make文件中的循环
shell
、
gnu
、
gnu-make
例如: $(foreach
fpga
, $($(NE_NAME)_$(DWDM_SUFFIX)_
FPGA
),ln -s $($(
fpga
)) $(PKG)/$(
fpga
);)
浏览 1
提问于2011-06-20
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1
回答
自定义类指针的排序向量
c++
、
sorting
、
c++11
、
vector
我有vector<
FPGA
*> current_generation_,我想使用sort_members函数按
FPGA
成员fitness_进行排序。适用的守则如下: return (
fpga
_first->fitness()<
fpga
_second->fitness());
fpga<
浏览 2
提问于2015-06-22
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1
回答
服务器
也在运行时,python套接字客户端会减慢速度。
python
、
sockets
我编写了一些小程序来使用python套接字在主机上创建客户机和
服务器
。在连接的另一边,我有我的
FPGA
板,它也运行LwIP客户端和
服务器
,连接是Gbit以太网。我的目标是发送和接收虚拟数据,并监控客户机和
服务器
的吞吐量。
浏览 18
提问于2022-10-15
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1
回答
FPGA
DE1-SoC Cyclone V覆盖设备树
linux
、
overlay
、
fpga
、
device-tree
、
cyclone
这是添加到socfpga.dtsi中节点soc的元素: base_
fpga
_region: base-
fpga
-region {
fpga
-bridges = <&
fpga
_bridge0>, <&
fpga
_bridge1>,管理器和桥
浏览 64
提问于2020-11-09
得票数 1
2
回答
创建UCF文件时出现错误?
vhdl
、
pins
、
spartan
;Net
fpga
_0_Ethernet_MAC_PHY_dv_pin= LVCMOS25;Net
fpga
_0= LVCMOS25; Net
fpga
_0_Ethernet_MAC_PHY_tx
浏览 2
提问于2013-06-10
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8
回答
寻找微型可编程
FPGA
+机器
cpu
、
fpga
我在找一台
FPGA
+机器。编辑:我想制作一个ASM图表,并将
FPGA
编程为我在图表中指定的行为
浏览 1
提问于2010-05-21
得票数 5
2
回答
cp命令在Make文件中出现错误
shell
、
unix
、
makefile
、
gnu
、
gnu-make
.**** for
fpga
in $(LIST_A); do\ for disFpga in $(LIST_B); do\ echo "SigningFile $$
fpga
";\
浏览 0
提问于2011-06-21
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1
回答
在Yosys中,我收到了一个警告,说文本有8位宽,有人能详细说明一下吗
warnings
、
fpga
、
literals
、
formal-verification
、
yosys
/
FPGA
_memory/ROM_
FPGA
.v:1)警告:文本的宽度为8位,但值需要12位。(../
FPGA
_memory/ROM_
FPGA
.v:1)警告:文本的宽度为8位
浏览 7
提问于2020-10-04
得票数 0
2
回答
如何用微控制器编写点阵iCE40超级程序
c
、
fpga
、
stm32f4
、
ice40
我试图用iCE40单片机编写一个stm32F4超级
FPGA
程序,并试图弄清楚如何将配置文件加载到微控制器上,以便通过SPI将配置文件发送给
FPGA
进行编程。所有其他的时间来源于
FPGA
的编程行会。(
FPGA
_SS_GPIO_Port,
FPGA
_SS_Pin, GPIO_PIN_RESET); HAL_GPIO_WritePin(
FPGA
_Config_GPIO_Port,
FPGA
_Config_Pin, GPIO_PIN_S
浏览 4
提问于2019-09-10
得票数 1
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