/lib/gcc/x86_64-unknown-linux-gnu/4.6.3/../../../../lib/gcc/x86_64-unknown-linux-gnu/4.6.3/../../../../lib/gcc/x86_64-unknown-linux-gnu/4.6.3/../../../..
浏览 9提问于2015-03-31得票数 4
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Xilinx系统生成器可用于原始MATLAB参考模型和实际HW板之间的联合仿真。在VIVADO HLS中，我们可以按照类似的步骤在原始C++参考模型(在HDL语言的数据类型和算法优化之前)和实际的HW板之间进行协同仿真吗？
浏览 82提问于2020-06-11得票数 1
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export ARCH=armsource /home/Vivado/2014.4/settings64.shbash: /home/Vivado/2014.4/settings64.sh: No such file or directory
我的主目录中有Vivado文件。
浏览 0提问于2015-10-02得票数 -1
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我有一组python模块，我希望在linux和MinGW (Windows)上都能使用。虽然subprocess在Linux上运行良好，但在windows上，subprocess.call/Popen不断抛出错误，指出找不到所需的二进制文件。虽然只需在mingw提示符中键入" vivado“即可正常工作，并且vivado已启动，但如果我尝试通过子进程调用vivado，则会收到一个错误，提示找不到该文件。我的mingw环境路径变量包含：/c/Xilinx/<
浏览 0提问于2017-05-23得票数 1
我正在使用Ubuntu14.10 x64和Vivado设计套件2014.4的清晰安装和更新1。Vivado运行，但是Vivado HLS在启动时崩溃，没有任何错误。/vivado_hls Vivado(TM) HLS - High-Level(Linux_x86_64 version 3.16.0-34-generic) on Thu Apr 1
浏览 7提问于2015-04-16得票数 3
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在仿真中，三态驱动的行为是不可理解的。'0'; line_en <= '1'; line_en <= line_en;end process;
在仿真中
浏览 5提问于2022-08-04得票数 0
/pairserver.out: /opt/Xilinx/Vivado/2016.1/lib/lnx64.o/libstdc++.so.6: version `CXXABI_1.3.9' not found/pairserver.out: /opt/Xilinx/Vivado/2016.1/lib/lnx64.o/libstdc++.so.6: version `GLIBCXX_3.4.20
浏览 4提问于2018-09-20得票数 0
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使用linux find命令，如何匹配路径中包含字符串'/ip/axi_pcie_0/‘的任何子目录？ 示例查找输出： ./rtl/vlog/vivado.2020.a02/vivado.2020.a02.srcs/sources_1/ip/axi_pcie_0
./rtl/vlog/vivado.2020.a02/vivado.2020.a02.srcs&
浏览 26提问于2020-11-21得票数 0
我正在vivado 2020.2中构建一个vhdl项目。testdata\src\tst\vivado每次运行这个脚本时，test_data.txt的内容都会发生变化，在vivado环境中加载的数据也会发生变化，但是即使旧版本的test_data.txt已经被更新的版本所取代，模拟器仍然会加载旧的数据。我试着关闭vivado重
浏览 8提问于2022-04-23得票数 0
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Vivado HLS未能在kubuntu 17.10上编译c测试平台代码，同一个项目在Windows 10下编译得很好。从日志文件中我认为vivado将它的gcc4.6.3与系统gcc库混为一谈，有人能帮我避免这种情况吗？/Source/circuito_tb.c in debug mode
INFO: [HLS 200-10] Running '/opt/Xilinx/Vivado/2017.3/bin/unwrapped/Viva
浏览 10提问于2017-11-17得票数 1
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为了加快仿真速度，我想将仿真环境移植到验证器中。然而，当我编译axi_ram_sim_netlist.v文件时，事情出了问题。错误输出显示，Cannot find file containing module: 'RAMB36E1'和RAMB36E1在vivado中似乎是原始的。
浏览 1提问于2022-03-27得票数 -1
我在Linux中使用了pcap.h头文件来解析pcap文件。该程序将正确地编译和解析数据包。但是，我想将相同的逻辑放在FPGA上，为此，我使用了Xilinx Vivado HLS工具。我在Xilinx Vivado中遇到了链接pcap.h文件的问题。因此，现在我有两个选择: 1.如何在Xilinx Vivado HLS中链接外部库?
浏览 1提问于2018-04-06得票数 0
1回答
我在Linux上，我用的是questasim 2012.2b。/mkProject.tcl line 11我让vivado生成库，它位于文件夹dsp_c中：
dsp_c.dcp dsp_c_funcsim.vhdl dsp_c_stub.v dsp_c.xc
浏览 1提问于2015-07-10得票数 1
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/tps/lnx64/jre/lib/amd64/server/libjvm.so(JVM_handle_linux_signal+0xb6) [0x7f96f04a2f26]/li
浏览 6提问于2017-03-06得票数 0
/xsetup在Ubuntu上安装了Vivado 2019.1。我没有注意Vivado的安装位置，所以默认情况下它安装在/tools/Xilinx/Vivado中。
浏览 0提问于2019-07-04得票数 2
我试图创建一个7段领导计数器，我有两个问题是，一个直通g只显示为X在一个模拟波形，我不知道如何采取Q，这是目前的状态，并使它的波形到测试台。我认为它应该类似于在测试平台中创建连接，名为Q2、Q1和Q0，并添加它们，比如.q、等等，但它似乎不喜欢这样。我对此非常陌生，所以这可能是很简单的事情。谢谢!input u,input clk,output reg b,output reg d,
outpu
浏览 3提问于2017-03-12得票数 0
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if(i) else end在合成此代码之后，在使用ModelSim模拟器进行后合成-仿真过程中似乎Vivado会自动将"b“信号添加到敏感度列表中，不是吗？
浏览 2提问于2016-12-27得票数 2
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我目前已经制作了GUI，并且能够将数据发送到它成功接收的服务器(当服务器在红色火龙果上运行时)，但是，我不确定如何使用Vivado 2019.1将服务器接收到的数据发送到我在框图中创建的特定输入。我假设基本上，谁能告诉我如何将我的C服务器代码与Vivado中的方块图的输入进行接口。我的红色pitaya板通过以太网连接到我的PC，它有自己的IP地址，我用它在PuTTY中运行它的linux服务器。我使用gcc在Pu
浏览 6提问于2019-08-20得票数 0
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