
走向未来(kdd.wang@gmail.com)
随着人工智能(AI)大模型对算力需求的爆炸性增长,半导体行业正经历从“延续摩尔”到“超越摩尔”的深刻变革。异构集成(Heterogeneous Integration),特别是基于芯粒(Chiplet)的先进封装技术,已成为驱动未来高性能计算(HPC)和AI芯片发展的核心引擎。然而,作为连接各个芯粒的“神经网络”,互连技术的物理极限正成为整个系统性能提升的“最后一道关卡”。当前最前沿的混合键合(Hybrid Bonding)技术虽已将互连间距推向微米甚至亚微米级别,但在Die-to-Die(D2D)和Die-to-Wafer(D2W)应用中,其对表面颗粒物的极端敏感性导致了严峻的良率与成本挑战。
本文基于佐治亚理工学院的一篇论文《Inverse Hybrid Bonding with Metal Organic Framework as Infill for Heterogeneous Integration》,对一种名为“逆向混合键合(Inverse Hybrid Bonding, IHB)”的颠覆性技术进行深度剖析。感兴趣的读者,可以从“走向未来”【https://t.zsxq.com/xpWzq】知识星球中获取该论文的全文进行深度研读。IHB通过“先进行直接铜键合,再进行气相介电质填充”的逆向工艺流程,从根本上解决了传统混合键合的“颗粒物瓶颈”。本文将详细拆解IHB的技术原理、实验验证过程,并从产品、技术和市场的专家视角,评估其对未来AI芯片架构、先进封装产业格局以及新兴技术(如硅光、玻璃基板)的深远影响。
我们正处在一个由AI定义的时代。大型语言模型(LLM)的参数量从数十亿迅速膨胀至万亿级别,每一次迭代都对算力提出了近乎贪婪的需求。然而,支撑了半导体行业半个世纪辉煌的摩尔定律,其经济和物理效益正逼近极限。如下图所示,28纳米节点之后,每晶体管的成本不降反升,标志着单纯依靠工艺节点缩放(Scaling)来提升性能和降低成本的黄金时代已然落幕。

图1:先进制程节点的单位晶体管成本趋势,揭示了摩尔定律经济效益的放缓。
与此同时,单片集成(Monolithic Integration)的系统级芯片(SoC)在面对AI加速器等超大规模芯片设计时,也遭遇了“三座大山”:
在此背景下,半导体行业将目光转向了“超越摩尔”的技术路径,异构集成应运而生。
异构集成的核心思想是将一个庞大的单片SoC,按照功能拆分成多个更小、更易于制造的独立芯粒(Chiplet)。这些Chiplet可以采用最适合其功能的工艺节点进行制造(例如,CPU核心用5nm,IO接口用16nm),然后通过先进的封装技术将它们重新“组装”成一个功能完整的系统。

图2:单片集成与基于Chiplet的异构集成架构对比。
这种“化整为零,再聚沙成塔”的模式带来了革命性的优势:
从AMD的Ryzen/EPYC处理器,到Intel的Ponte Vecchio GPU,再到各大云厂商的自研AI芯片,Chiplet架构已成为高性能计算领域的标准范式。TSMC的CoWoS、InFO,以及Intel的EMIB、Foveros等2.5D/3D封装技术,正是这场革命的基石。然而,当所有目光聚焦于这些宏伟的系统架构时,一个根本性的挑战浮出水面:如何高效、可靠地连接这些Chiplet?
这一问题不仅是硬件工程师面临的挑战,也深刻影响着上层AI应用的发展路径。欢迎加入“走向未来”知识星球【https://t.zsxq.com/xpWzq】,和我们一起探讨生成式人工智能、大模型、AI芯片和AIGC的产品、技术和应用实践,从底层硬件创新到上层应用落地,共同探索如何使用各种不同的人工智能大模型和智能体来为工作增效,为生活添彩,一起走向AGI的未来。
系统的性能上限,最终取决于其最薄弱的一环。在异构集成系统中,这一环就是连接Chiplet的“片间互连”(Off-chip Interconnects)。互连技术的优劣直接决定了系统的带宽密度、功耗、延迟和整体可靠性。
互连技术的发展路径,本质上是一部追求更高密度、更小间距的历史。

图3:从C4焊球到混合键合,互连技术的间距与密度演进趋势。

图4:混合键合工艺流程:先进行介电质键合,再通过退火完成铜互连。
混合键合的革命性在于它无需底部填充胶,可以实现极小的互连间距(已展示<1µm)和极高的互连密度(>10⁶/mm²),从而带来无与伦比的带宽和能效。
尽管混合键合在晶圆对晶圆(Wafer-to-Wafer, W2W)的应用中(如CMOS图像传感器)已相当成熟,但在更为灵活和高价值的Die-to-Die(D2D)和Die-to-Wafer(D2W)场景中,却面临一个致命的悖论。
D2D/D2W的核心优势在于可以使用“已知合格的裸片”(Known Good Die, KGD)进行集成,从而大幅提升复杂多芯片系统的最终良率。然而,这个过程引入了一个关键步骤:晶圆切割(Dicing)。切割过程,无论是传统的刀片切割还是先进的激光切割,都不可避免地会在芯片表面和边缘产生微小的颗粒物。
对于混合键合而言,这些颗粒物是“天敌”。由于其第一步是脆弱的、依赖范德华力的介电质表面键合,一个纳米级的颗粒就足以在其周围形成一个直径大几十倍的空洞(Void),彻底破坏该区域的键合,导致电气连接失败和结构可靠性问题。这意味着,D2D/D2W混合键合需要在ISO 3甚至更高级别的超洁净环境中,对芯片进行极其严苛的清洗和处理。这种对“零颗粒”的追求,极大地增加了工艺的复杂性、成本和不确定性,成为制约其大规模应用于超大算力AI芯片(这些芯片往往由多个大型Chiplet构成)的良率瓶颈。如何在享受D2D/D2W高良率潜力的同时,摆脱颗粒物污染的梦魇? 这正是逆向混合键合(IHB)试图解答的核心问题。
IHB技术的核心思想,在于颠倒传统混合键合的工艺顺序,从而在根本上规避其对表面洁净度的极端依赖。

图5:IHB工艺流程:先完成稳健的铜-铜直接键合,再进行气相介电质填充。
IHB是一个清晰的两步过程:
这种“逆向”操作带来了本质性的改变:
IHB本质上是融合了直接铜键合的稳健性和气相沉积的高深宽比填充能力,创造出一种全新的、更适应于D2D/D2W应用场景的细间距互连解决方案。
论文系统性地探索并验证了IHB技术的关键环节。其研究路径清晰地展示了从理论到实践的演进过程。
研究的第一步是确保能够实现高质量的铜-铜直接键合。
这是IHB技术最具创新性的部分。研究团队对两种候选填充材料进行了系统评估。
初次尝试:氧化铝(Al₂O₃)
这次尝试虽然没有成功,但验证了气相填充的概念,并为工艺参数(如吹扫方式)的优化积累了宝贵经验。
突破性进展:金属有机框架(ZIF-8 MOF)
有了理想的材料,接下来的关键是优化工艺,以实现在没有顶部通孔的情况下,仅从芯片四周进行完全填充。这是IHB能否走向实用的决定性一步。
研究团队进行了一系列精巧的实验设计:
基于这一关键发现,研究团队移除了所有顶部通孔,在140µm间距的测试芯片上成功演示了首个完整的IHB流程:
为了验证IHB技术在更先进节点下的潜力,研究进一步挑战了5µm互连间距和500nm芯片间隙的极限场景。
这一结果虽然不完美,但极具价值。它不仅成功将IHB技术的可行性推进到了5µm间距的水平,也清晰地指出了下一步的优化方向:需要对MOF的转化步骤(如温度、压力、时间)进行更精细的调控,以确保在超窄间隙内的转化效率。
作为一名AI芯片领域的专家,我认为IHB技术不仅仅是一项学术上的创新,它精准地切中了当前先进封装领域的核心痛点,预示着巨大的市场潜力。
对于NVIDIA、AMD、Intel以及各大云服务商的旗舰AI加速器而言,其核心就是由多个大型Chiplet构成的复杂系统。在D2W/D2D混合键合中,每提升一个百分点的良率,都意味着节约数百万乃至数千万美元的制造成本。
IHB通过其对颗粒物的天然耐受性,有望将D2D/D2W的细间距互连良率提升到一个新的台阶。这对于推动更大规模、更多Chiplet的AI处理器(例如,集成数十个计算和内存Chiplet的下一代GPU)的商业化落地,具有决定性的战略意义。它可以降低对超洁净生产环境的依赖,从而降低整体封装的资本开销和运营成本。
IHB的潜力远不止于此,它可能成为解锁未来多种先进技术路径的关键。
尽管前景广阔,IHB作为一项新兴技术,其商业化之路仍需克服若干挑战:
逆向混合键合(IHB)技术通过一个看似简单却极其深刻的工艺顺序颠倒,精准地破解了当前D2D/D2W细间距互连技术中最棘手的“颗粒物-良率”困局。它将直接铜键合的稳健性和金属有机框架(MOF)气相沉积的卓越填充能力完美结合,不仅展示了在5µm间距下实现高密度互连的巨大潜力,更为硅-玻璃集成、下一代HBM等前沿领域开辟了新的技术路径。
在AI算力需求永无止境的推动下,异构集成的复杂度和集成密度将持续攀升。可以预见,像IHB这样能够从根本上解决核心制造瓶颈、提升良率并降低成本的颠覆性技术,将成为决定下一代AI芯片竞争格局的关键。尽管仍处于研发和优化阶段,但IHB无疑为“超越摩尔”时代的先进封装技术版图,描绘了一幅极具想象力的未来蓝图。
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