摸鱼范式

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空白的贝塔

【日更计划117】数字IC基础题【UVM部分】

如果由于超出最大时间的某些错误而导致测试无法进行,那么仿真超时机制有助于停止仿真。在UVM中,set_global_timeout(timeout)是一个便捷函...

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【日更计划116】数字IC基础题【UVM部分】

工厂是UVM中使用的一种特殊查找表,用于创建组件或事务类型的对象。使用工厂创建对象的好处是,测试平台构建可以在运行时决定创建哪种类型的对象。因此,一个类可以用另...

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【日更计划115】数字IC基础题【UVM部分】

virtual sequence是控制多个sequencer中激励生成的序列。由于sequence,sequencer和driver集中在单个接口上,因此几乎所...

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【日更计划114】数字IC基础题【UVM部分】

try_next_item(), item_done(), and put() 是非阻塞的

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【日更计划113】数字IC基础题【UVM部分】

get_next_item是一个阻塞方法(driver-sequencer API的一部分),阻塞直到sequence_item可供driver处理为止,并返回...

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空白的贝塔

【日更计划105】数字IC基础题【验证部分】

这是测试你对不同工具的意识的一个普遍问题。根据你对各种工具的回答和经验,还可能会询问你在使用这些工具时可能遇到的难易程度/局限性方面的观点。没有固定的答案,但是...

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数字IC设计验证-秋招指南

现在距离正式九月正式秋招还有4个月,距离八月提前批还有3个月,相信不少粉丝都在盘算着为工作做准备。今天,我以一个过来者的身份跟大家分享分享,关于秋招如何准备以及...

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【日更计划104】数字IC基础题【验证部分】

单端口RAM只有一个读和写端口。因此,它只能在任何给定的时间点进行读或写操作。其他需要考虑验证的设计规范包括RAM大小、地址和数据总线的宽度。基于此,以下是一些...

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【摸鱼范式】【一】UVM入门教程【文字版】

建议准备仿真软件,熟悉VCS的同学可以直接使用VCS,不熟悉的同学建议直接再win平台的Questa就行了。

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【日更计划103】数字IC基础题【验证部分】

在覆盖率驱动的验证方法中,验证计划是通过将每个特性或场景映射到一个覆盖率监视器来实现的,该监视器在仿真期间收集覆盖率信息。

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【日更计划103】数字IC基础题【SV部分】

DPI是直接编程接口的缩写,它是SystemVerilog和C/C++等外语编程语言之间的接口。DPI允许在接口两边的语言之间直接进行跨语言函数调用。在C语言中...

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【日更计划102】数字IC基础题【SV部分】

2比1更好,在1中,每次迭代都需要计算length*count,2中只需要计算一次

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svlib文档翻译(第一至四章)

本文版权所有©Verilab Inc. 2014-2015。本文作为svlib使用库的附加信息。本文件允许无限复制,但必须包括第一章的全部内容,不得修改。

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svlib文档翻译(第五章)

SystemVerilog语言本身提供了许多字符串操作。然而,经验表明,内置方法不足以满足工作中的字符串处理任务,svlib提供了进一步的操作集来帮助满足这些需...

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【日更计划101】数字IC基础题【SV部分】

在约束中,不允许调用方向为ref的函数,除非使用“const ref”,这保证函数在内部不会修改参数。

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【日更计划100】数字IC基础题【SV部分】

mailbox是一种通信机制,用于线程之间的数据交换。数据在一个线程存入mailbox中,在另一个线程中检索。下面是mailbox的声明与创建的示例:

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【日更计划099】数字IC基础题【SV部分】

约束表达式中,至多只有一个关系运算符(<,<=,==,>=或>)。如果要实现变量的顺序约束,需要多个表达式。

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【日更计划098】数字IC基础题【SV部分】

systemverilog支持三种类型的动态进程,可以在运行时创建,并作为独立线程执行。

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【日更计划097】数字IC基础题【SV部分】

这些是systemverilog内建的回调函数。在调用randomize之前会自动调用pre_randomize函数,之后会自动调用post_randomize...

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复微杯第一名参赛经验分享

各位芯片设计爱好者,大家好,今天给大家分享本人(CSDN:摆渡沧桑)参加电子设计大赛的经验,仅供参考。去年参加了第二届“复微杯”全国大学生电子设计大赛数字赛道,...

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