科学计算

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猫叔Rex

FPGA复位的正确打开方式

本篇文章参考Xilinx White Paper:Get Smart About Reset: Think Local, Not Global

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猫叔Rex

FPGA时序约束之Tcl命令的对象及属性

在前面的章节中,我们用了很多Tcl的指令,但有些指令并没有把所有的参数多列出来解释,这一节,我们就把约束中的Tcl指令详细讲一下。

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猫叔Rex

1 Julia简介及安装

一群拥有各种语言丰富编程经验的Matlab高级用户,对现有的科学计算编程工具感到不满——这些软件对自己专长的领域表现得非常棒,但在其它领域却非常糟糕。他们想要的...

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猫叔Rex

2.Julia REPL 变量

在package模式下,可以增加、删除各种库,相当于用Pkg这个模块来操作; package模式下的add GR相当于Pkg.add("GR") package...

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猫叔Rex

FPGA时序约束实战篇之衍生时钟约束

系统中有4个衍生时钟,但其中有两个是MMCM输出的,不需要我们手动约束,因此我们只需要对clk_samp和spi_clk进行约束即可。约束如下:

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猫叔Rex

FPGA时序约束实战篇之主时钟约束

在这一节开讲之前,我们先把wave_gen工程的wave_gen_timing.xdc中的内容都删掉,即先看下在没有任何时序约束的情况下会综合出什么结果?

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猫叔Rex

FPGA时序约束实战篇之梳理时钟树

我们以Vivado自带的wave_gen工程为例,该工程的各个模块功能较为明确,如下图所示。为了引入异步时钟域,我们在此程序上由增加了另一个时钟--clki...

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猫叔Rex

Virtex7 Microblaze下DDR3测试

这篇文章我们讲一下Virtex7上DDR3的测试例程,Vivado也提供了一个DDR的example,但却是纯Verilog代码,比较复杂,这里我们把DDR3的...

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猫叔Rex

Matlab高效编程技巧

用过Matlab的同学应该都知道,Matlab的慢是出了名的,但是再慢也有优化的方式,下面我们给出几个Matlab编程中常用的优化技巧。

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猫叔Rex

FPGA时序约束理论篇之两种时序例外

上面我们讲的是时钟周期约束,默认按照单周期关系来分析数据路径,即数据的发起沿和捕获沿是最邻近的一对时钟沿。如下图所示。

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猫叔Rex

FPGA时序约束理论篇之时钟周期约束

时钟周期约束,顾名思义,就是我们对时钟的周期进行约束,这个约束是我们用的最多的约束了,也是最重要的约束。

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猫叔Rex

FPGA时序约束理论篇之时序路径与时序模型

典型的时序路径有4类,如下图所示,这4类路径可分为片间路径(标记①和标记③)和片内路径(标记②和标记④)。

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猫叔Rex

FPGA时序约束理论篇之建立保持时间

首先来看什么是时序约束,泛泛来说,就是我们告诉软件(Vivado、ISE等)从哪个pin输入信号,输入信号要延迟多长时间,时钟周期是多少,让软件PAR(Pl...

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猫叔Rex

DCM/DLL/PLL/MMCM区别

对于FPGA工程师来说,DCM/DLL/MMCM/PLL这些词简直每天都能看到,但很多人并不是很清楚它们之间的差异。

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猫叔Rex

github多账户切换

由于工作需要,有两个github的账号,需要经常切换账户,下面展示具体操作步骤。

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猫叔Rex

Vivado生成HDL例化模板

在ISE的开发中,可以很方便的生成HDL文件的例化模板,但vivado中,很多同学并没有找到这个功能,其实功能还是有的,只不过在vivado中很多功能可以通...

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猫叔Rex

哪种均线组合才是最优的?

均线策略应该是我们刚进入股市时就听过的一个策略,而双均线策略,顾名思义,就是两根均线:短期均线和长期均线。当短线均线上穿长期均线(金叉)时买入,当短期均线下穿长...

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猫叔Rex

13 如何写出高性能的Julia

全局变量的值和类型随时都会发生变化。 这使编译器难以优化使用全局变量的代码。 变量应该是局部的,或者尽可能作为参数传递给函数。

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猫叔Rex

12 Julia科学计算

跟Python中的pandas的用法很像,相信用过Pandas的朋友上手应该无压力

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猫叔Rex

6 Julia 类型

Julia中没有class,也没有子类型的继承关系,所有具体类型都是最终的,并且只有抽象类型可以作为其超类型。Julia中的继承是继承行为,而不是继承结构。

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