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LV1
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FPGA开源网站和论坛

进入后,选择project或者由http//www.opencores.org/browse.cgi/by_category进入。

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FPGA与LVDS信号兼容性分析方法

很多工程师在使用Xilinx开发板时都注意到了一个问题,就是开发板中将LVDS的时钟输入(1.8V电平)连接到了VCCO=2.5V或者3.3V的Bank上,于是...

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国产FPGA概况

时至今日,不管从国际形势还是国家对于“中国芯”的扶持,“国产化”这一话题越来越要付出实践,对于FPGA这一“万能芯”也是很多企业会优先考虑的。

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SerDes知识详解

也存在一些介于SerDes和并行接口之间的接口类型,相对源同步接口而言,这些中间类型的接口也使用串行器(Serializer)解串器(Deserializer)...

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深入浅出理解SerDes

我们平时使用的I2C、串口等其实都是串行总线,但是因为他们速度较低、时序简单,所以很少在高速串行总线时被提及。但是在高速时代的今天,一些高速总线,如LVDS、M...

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FPGA开源工具链

2、然后执行备份命令,执行 sudo cp sources.list sources.list.backup 对源文件内容进行备份,以防万一。

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FPGA上电后IO的默认状态

在进行FPGA硬件设计时,引脚分配是非常重要的一个环节,特别是在硬件电路上需要与其他芯片通行的引脚。Xilinx FPGA从上电之后到正常工作整个过程中各个阶段...

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数字芯片社区

公众号:【数字ICer】数字IC、FPGA、Linux、Python、UVM、SV、信号处理等学习笔记,快乐学习,一起进步。

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ExASIC

分享数字集成电路设计中的经验和方法。分享让工作更轻松。

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高级FPGA设计技巧!多时钟域和异步信号处理解决方案

有一个有趣的现象,众多数字设计特别是与FPGA设计相关的教科书都特别强调整个设计最好采用唯一的时钟域。换句话说,只有一个独立的网络可以驱动一个设计中所有触发器的...

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回归并行!芯片到芯片的最新超高速通信方式:超短距(USR)接口

超短距离(USR)接口在2.5D封装技术上的重要性日益提高,已导致各种电气定义和电路实现。台积电最近介绍了其IP开发团队采用的方法,该方法用于并行总线,时钟转发...

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从PCI被“拍在沙滩上”谈并行总线和串行总线

在高速串行总线流行起来之前,芯片之间的互联通过系统同步或者源同步的并行接口传输数据,而所谓的并行接口,是指通信中一个或几个字节(8位)数据是在n*8条并行传输线...

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PCIe“拍了拍”PCI- PCI和PCIe发展历史

自PC在1981年被IBM发明以来,主板上都有扩展槽用于扩充计算机功能。现在最常见的扩展槽是PCIe插槽,实际上在你看不见的计算机主板芯片内部,各种硬件控制模块...

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Vivado联合modelsim仿真

之前有分享过《modelsim se 2019.2安装教程》及《vivado2018 中使用modelsim联合仿真》,今天就带来Vivado与Modesim联...

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FPGA 主流芯片选型指导和命名规则(一)

题目可能有点大,主要介绍Xilinx和Altera公司的主流芯片的选型(包括中低高端产品的介绍)和两大厂家的命名规则,主要看封装和逻辑数量。

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FPGA Fanout-Fanin(扇入扇出)

扇入系数是指门电路允许的输入端数目。一般门电路的扇入系数为1—5,最多不超过8。扇出系数是指一个门的输出端所驱动同类型门的个数,或称负载能力。一般门电路的扇出系...

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case/casez/casex 区别与综合

首先,一般性的常识是使用casez,强烈的建议不要使用casex,(虽然我没有这个常识)。这是为啥呢?待续。

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PLL、DLL、DCM区别及应用

主要包括PLL原理、DLL原理和DCM原理,应用可能只会简单说一说,具体以原理为主。

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FPGA 的功耗概念与低功耗设计研究

随着半导体工艺的飞速发展和芯片工作频率的提高 ,芯片的功耗迅速增加 ,而功耗增加又导致芯片发热量的增大和可靠性的下降 。因此 ,功耗已经成为深亚微米集成电路设计...

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基于 FPGA 的数字表示

在FPGA系统中有两个基本准则非常重要,分别为:数字表示法和代数运算的实现。本博文主要介绍数字表示。   参考文献:数字信号处理的FPGA实现(第3版)中文版 ...

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