科学计算

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猫叔Rex

Xilinx FPGA Partial Reconfiguration 部分重配置 详细教程

Partial Reconfiguration(部分重配置)在现在的FPGA应用中越来越常见,我们这次的教程以Project模式为例来说明部分重配置的操作过...

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猫叔Rex

为什么信号的时宽带宽积是常数?

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猫叔Rex

11 并行计算

但可以读出,fetch只能读第一个数据,但不会把该数据从Channel中删除,但take!会读出后删除。

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猫叔Rex

10 元编程

元编程(英语:Metaprogramming),又译超编程,是指某类计算机程序的编写,这类计算机程序编写或者操纵其它程序(或者自身)作为它们的资料,或者在运行时...

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猫叔Rex

9 模块

模块是一些互相隔离的工作空间,用法上类似于Python中的库,在Python中导入库时,使用import * as *的方式,在Julia中,采用using或i...

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猫叔Rex

8 Julia IO操作

除了txt格式外,Julia还可以对csv等格式,但Julia自带的数据序列化工具JLD2速度速度更快,扩平台,重点推荐。

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猫叔Rex

7 Julia绘图工具

Plots配合portfoliocomposition能够画出代码量少而且有内容丰富的图片,但在Julia v1.0版本中好像目前还不支持,等支持后会专门做一个...

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5 Julia控制

此时如果在for循环外面查看x的值,则会提示error,因为变量x只是for循环内部的。

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猫叔Rex

4 函数 方法 多重分派

函数的最后一行是不需要加return的,return一般用于在函数中间返回时使用。因为Julia的代码都是表达式(在后面的元编程一节中会讲到),表达式是有返回值...

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猫叔Rex

PYNQ 经典项目分享之 - Hello World

此项目解释了如何在FPGA上使用resizer IP来调整图像的大小。其中对比了两种图像大小调整的解决方案的运算速度,其中之一为使用Python I...

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猫叔Rex

费马猜想有哪些?为什么数学家们花了数百年时间去证明?

费马,可能很多朋友没听过这个名字,但费马大定理,在数学界的知名度很高,费马是一名数学爱好者(费马,1601~1665)。因为他还有一份正经工作,他的职业是一名律...

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猫叔Rex

C++ vector用法详解

vector的元素在内存中连续排列,这一点跟数组一样。这意味着我们元素的索引将非常快,而且也可以通过指针的偏移来获取vector中的元素。

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猫叔Rex

SystemVerilog教程之数据类型1

我们知道,Verilog中,有两种基本的数据类型:reg和wire,reg在always、initial、task和funciton中被赋值,wire使用a...

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猫叔Rex

Vivado中模块封装成edif和dcp

我们完成Vivado的工程后,大部分情况不能把整个工程的源代码都直接给客户或者其他工程师,需要我们先进行一些封装后再给他们,就像软件代码中会编译成dll后再...

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猫叔Rex

自动驾驶入门之视觉定位坐标转换

世界坐标系是在环境当中选定的一个三维坐标系,用于描述环境中任何物体的位置,符合右手坐标系。相机坐标系的原点位于镜头的光心,x,y轴分别与相机的边缘平行,z轴...

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猫叔Rex

为什么推荐使用XPM?

首先,什么是XPM?可能很多人没听过也没用过,它的全称是Xilinx Parameterized Macros,也就是Xilinx的参数化的宏,跟原语的例化...

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猫叔Rex

FPGA时序约束之Vivado辅助工具

上面我们讲的都是xdc文件的方式进行时序约束,Vivado中还提供了两种图形界面的方式,帮我们进行时序约束:时序约束编辑器(Edit Timing Cons...

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FPGA时序约束实战篇之延迟约束

对于延迟约束,相信很多同学是不怎么用的,主要可能就是不熟悉这个约束,也有的是嫌麻烦,因为有时还要计算PCB上的走线延迟导致的时间差。而且不加延迟约束,Viv...

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猫叔Rex

FPGA时序约束实战篇之多周期路径约束

首先来看带有使能的数据,在本工程中的Tming Report中,也提示了同一个时钟域之间的几个路径建立时间不满足要求

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猫叔Rex

FPGA时序约束实战篇之伪路径约束

在本章节的“2 约束主时钟”一节中,我们看到在不加时序约束时,Timing Report会提示很多的error,其中就有跨时钟域的error,我们可以直接在...

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